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参数资料
型号： M470T6554CZ0-CLD5
厂商： SAMSUNG SEMICONDUCTOR CO. LTD.
英文描述： DDR2 Unbuffered SODIMM 200pin Unbuffered SODIMM based on 512Mb C-die 64bit Non-ECC
中文描述： 内存缓冲的SODIMM 200pin缓冲的SODIMM上的512Mb基于C模具64非ECC
文件页数： 3/18页
文件大小： 328K
代理商： M470T6554CZ0-CLD5
Rev. 1.2 Aug. 2005
256MB, 512MB, 1GB Unbuffered SODIMMs
DDR2 SDRAM
Pin Configurations (Front side/Back side)
Note : NC = No Connect; NC, TEST(pin 163)is for bus analysis tool and is not connected on normal memory modules.
Pin
1
Front
V
REF
V
SS
DQ0
Pin
2
Back
V
SS
DQ4
Pin
51
Front
DQS2
V
SS
DQ18
Pin
52
Back
DM2
V
SS
DQ22
Pin
101
Front
A1
V
DD
A10/AP
Pin
102
Back
A0
V
DD
BA1
Pin
151
Front
DQ42
Pin
152
Back
DQ46
3
4
53
54
103
104
153
DQ43
V
SS
DQ48
154
DQ47
V
SS
DQ52
5
6
DQ5
V
SS
DM0
V
SS
DQ6
DQ7
V
SS
DQ12
DQ13
V
SS
DM1
V
SS
CK0
CK0
V
SS
DQ14
DQ15
V
SS
V
SS
DQ20
55
56
105
106
155
156
7
DQ1
V
SS
DQS0
DQS0
V
SS
DQ2
DQ3
V
SS
DQ8
DQ9
V
SS
DQS1
DQS1
V
SS
DQ10
DQ11
V
SS
V
SS
DQ16
8
57
DQ19
V
SS
DQ24
DQ25
V
SS
DM3
NC
V
SS
DQ26
DQ27
V
SS
CKE0
V
DD
NC
BA2
V
DD
A12
58
DQ23
V
SS
DQ28
DQ29
V
SS
DQS3
DQS3
V
SS
DQ30
DQ31
V
SS
NC/CKE1
V
DD
NC
NC
V
DD
A11
107
BA0
108
RAS
157
158
9
10
59
60
109
WE
V
DD
CAS
NC/S1
V
DD
NC/ODT1
V
SS
DQ32
DQ33
V
SS
DQS4
DQS4
V
SS
DQ34
DQ35
V
SS
DQ40
110
S0
V
DD
ODT0
A13
V
DD
NC
V
SS
DQ36
DQ37
V
SS
DM4
V
SS
DQ38
DQ39
V
SS
DQ44
159
DQ49
V
SS
NC, TEST
V
SS
DQS6
DQS6
V
SS
DQ50
DQ51
V
SS
DQ56
DQ57
V
SS
DM7
V
SS
DQ58
160
DQ53
V
SS
CK1
CK1
V
SS
DM6
V
SS
DQ54
DQ55
V
SS
DQ60
DQ61
V
SS
DQS7
DQS7
V
SS
DQ62
11
13
15
12
14
16
61
63
65
62
64
66
111
113
115
112
114
116
161
163
165
162
164
166
17
19
21
18
20
22
67
69
71
68
70
72
117
119
121
118
120
122
167
169
171
168
170
172
23
25
27
29
31
24
26
28
30
32
73
75
77
79
81
74
76
78
80
82
123
125
127
129
131
124
126
128
130
132
173
175
177
179
181
174
176
178
180
182
33
35
37
34
36
38
83
85
87
84
86
88
133
135
137
134
136
138
183
185
187
184
186
188
39
40
89
90
139
140
189
190
41
42
91
A9
92
A7
141
142
DQ45
V
SS
DQS5
191
DQ59
V
SS
SDA
192
43
44
93
A8
V
DD
A5
94
A6
V
DD
A4
143
DQ41
V
SS
DM5
V
SS
144
193
194
DQ63
V
SS
SA0
45
DQ17
V
SS
DQS2
46
DQ21
V
SS
NC
95
96
145
146
195
196
47
48
97
98
147
148
DQS5
V
SS
197
SCL
V
DD
SPD
198
49
50
99
A3
100
A2
149
150
199
200
SA1
Pin Description
Pin Name
Function
Pin Name
Function
CK0,CK1
Clock Inputs, positive line
SDA
SPD Data Input/Output
CK0,CK1
Clock Inputs, negative line
SA1,SA0
SPD address
CKE0,CKE1
Clock Enables
DQ0~DQ63
Data Input/Output
RAS
Row Address Strobe
DM0~DM7
Data Masks
CAS
Column Address Strobe
DQS0~DQS7
Data strobes
WE
Write Enable
DQS0~DQS7
Data strobes complement
S0,S1
Chip Selects
TEST
Logic Analyzer specific test pin
(No connect on So-DIMM)
A0~A9, A11~A13
Address Inputs
V
DD
V
SS
V
REF
V
DD
SPD
NC
Core and I/O Power
A10/AP
Address Input/Autoprecharge
Ground
BA0,BA1
SDRAM Bank Address
Input/Output Reference
ODT0,ODT1
On-die termination control
SPD Power
SCL
Serial Presence Detect(SPD) Clock Input
Spare pins, No connect
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PDF描述
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