MA320001 (Microchip) PDF资料下载 Datasheet(70/208 页)

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参数资料

型号：	MA320001
厂商：	Microchip Technology
文件页数：	70/208页
文件大小：	0K
描述：	MODULE PLUG-IN PIC32 100QFP
视频文件：	PIC32 Board Selection
标准包装：	1
附件类型：	插拔式模块（PIM）- PIC32MX360F512L
适用于相关产品：	Explorer 16（DM240001 或 DM240002）
产品目录页面：	658 (CN2011-ZH PDF)

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TABLE 4-23:

PORT C REGISTERS MAP FOR PIC32MX320F128L, PIC32MX340F128L, PIC32MX360F256L, PIC32MX360F512L,

PIC32MX440F128L, PIC32MX460F256L AND PIC32MX460F512L DEVICES ONLY (1)

Bits

31/15

30/14

29/13

28/12

27/11

26/10

25/9

24/8

23/7

22/6

21/5

20/4

19/3

18/2

17/1

16/0

6080

6090

60A0

TRISC

PORTC

LATC

31:16

15:0

31:16

15:0

31:16

15:0

—

TRISC15

—

RC15

—

LATC15

—

TRISC14

—

RC14

—

LATC14

—

TRISC13

—

RC13

—

LATC13

—

TRISC12

—

RC12

—

LATC12

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

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—

—

—

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—

—

—

—

—

—

—

—

—

—

—

—

—

TRISC4

—

RC4

—

LATC4

—

TRISC3

—

RC3

—

LATC3

—

TRISC2

—

RC2

—

LATC2

—

TRISC1

—

RC1

—

LATC1

—

—

—

—

—

—

0000

F01E

0000

xxxx

0000

xxxx

60B0

ODCC

31:16 — — — —

15:0 ODCC15 ODCC14 ODCC13 ODCC12

—

—

—

—

—

—

—

—

—

—

—

—

— — — — —

— ODCC4 ODCC3 ODCC2 ODCC1

—

—

0000

0000

Legend:

Note 1:

x = unknown value on Reset, — = unimplemented, read as ‘ 0 ’. Reset values are shown in hexadecimal.

All registers in this table have corresponding CLR, SET and INV Registers at their virtual addresses, plus offsets of 0x4, 0x8 and 0xC, respectively. See Section 12.1.1 “CLR, SET and INV Registers” for more

information.

TABLE 4-24:

PORT C REGISTERS MAP FOR PIC32MX320F032H, PIC32MX320F064H, PIC32MX320F128H, PIC32MX340F128H,

PIC32MX340F256H, PIC32MX340F512H, PIC32MX420F032H, PIC32MX440F128H, PIC32MX440F256H AND

PIC32MX440F512H DEVICES ONLY (1)

Bits

31/15

30/14

29/13

28/12

27/11

26/10

25/9

24/8

23/7

22/6

21/5

20/4

19/3

18/2

17/1

16/0

6080

6090

60A0

TRISC

PORTC

LATC

31:16

15:0

31:16

15:0

31:16

15:0

—

TRISC15

—

RC15

—

LATC15

—

TRISC14

—

RC14

—

LATC14

—

TRISC13

—

RC13

—

LATC13

—

TRISC12

—

RC12

—

LATC12

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

—

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—

—

—

—

—

—

—

—

—

—

—

—

—

0000

F000

0000

xxxx

0000

xxxx

60B0

ODCC

31:16 — — — —

15:0 ODCC15 ODCC14 ODCC13 ODCC12

—

—

—

—

—

—

—

—

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—

—

—

—

—

—

—

—

—

—

—

—

—

—

0000

0000

Legend:

Note 1:

x = unknown value on Reset, — = unimplemented, read as ‘ 0 ’. Reset values are shown in hexadecimal.

All registers in this table have corresponding CLR, SET and INV Registers at their virtual addresses, plus offsets of 0x4, 0x8 and 0xC, respectively. See Section 12.1.1 “CLR, SET and INV Registers” for more

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