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参数资料
| 型号： | MAX1069BEUD+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 4/20页 |
| 文件大小： | 0K |
| 描述： | IC ADC 14BIT I2C 58KSPS 14-TSSOP |
| 标准包装： | 96 |
| 位数： | 14 |
| 采样率（每秒）： | 58k |
| 数据接口： | 串行 |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 12.5mW |
| 电压电源： | 单电源 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 14-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 14-TSSOP |
| 包装： | 管件 |
| 输入数目和类型： | 1 个单端，单极 |
MAX1069
forming a digital representation of the analog input sig-
nal. During the conversion period, the MAX1069 holds
SCL low (clock stretching).
The time required for the T/H to acquire an input signal
is a function of the analog input source impedance. If
the input signal source impedance is high, lengthen the
acquisition time by reducing fSCL. The MAX1069 pro-
vides two SCL cycles (tACQ), in which the track-and-
hold capacitance must acquire a charge representing
the input signal. Minimize the input source impedance
(RSOURCE) to allow the track-and-hold capacitance to
charge within the allotted time. RSOURCE should be
less than 12.9k
for fSCL = 400kHz and less than 2.4k
58.6ksps, 14-Bit, 2-Wire Serial ADC
in a 14-Pin TSSOP
12
______________________________________________________________________________________
Figure 3. MAX1069 Simplified Functional Diagram
AIN
AGNDS
CONTROL
LOGIC
4MHz
INTERNAL
OSCILLATOR
OUTPUT SHIFT
REGISTER
T/H
SAR
ADC
REF
CLOCK
IN
OUT
+4.096V
REFERENCE
REFADJ
REF
5k
ADD0
ADD1
ADD2
ADD3
DVDD
AVDD
DGND
SCL
SDA
AGND
8
13
12
11
9
1
2
3
4
5
6
7
10
14
MAX1069
AV = 1.0
Figure 4. Typical Application Circuit
AIN
REF
10
F
0.1
F
REFADJ
AGNDS
AVDD
0.1
F
AGND
DGND
ANALOG
SOURCE
ADD1
ADD0
ADD2
SCL
SDA
DVDD
0.1
F
3.0V
5.0V
C
VDD
SDA
SCL
RP
ADD3
VSS
8
13
12
11
14
91
2
3
4
5
6
7
10
I2C ADDRESS IS 0110111
MAX1069
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