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参数资料
| 型号： | MAX5306EUE+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 10/15页 |
| 文件大小： | 0K |
| 描述： | IC DAC 12BIT OCT LP SER 16-TSSOP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 96 |
| 设置时间： | 5µs |
| 位数： | 12 |
| 数据接口： | 串行 |
| 转换器数目： | 8 |
| 电压电源： | 单电源 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
| 输出数目和类型： | 8 电压，单极；8 电压，双极 |
| 采样率（每秒）： | * |
| 产品目录页面： | 1397 (CN2011-ZH PDF) |
MAX5306/MAX5307
Low-Power, Low-Glitch, Octal 12-Bit Voltage-
Output DACs with Serial Interface
4
_______________________________________________________________________________________
ELECTRICAL CHARACTERISTICS (continued)
(VDD = +2.7V to +5.5V, GND = 0, VREF = VDD, CL = 200pF, RL = 2k
Ω, TA = TMIN to TMAX, unless otherwise noted. Typical values are
at VDD = +5V, TA = +25°C.)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
TIMING CHARACTERISTICS
Serial Clock Frequency
fSCLK
0
15
MHz
SCLK Pulse Width High
tCH
33
ns
SCLK Pulse Width Low
tCL
33
ns
CS Fall to SCLK Fall Setup Time
tCSS
16
ns
SCLK Fall to CS Rise Setup Time
tCSH
20
ns
LDAC Pulse Width Low
tLDACPWL
20
ns
CLR Pulse Width Low
tCLRPWL
MAX5307 only
20
ns
DIN to SCLK Fall Setup Time
tDS
16
ns
DIN to SCLK Fall Hold Time
tDH
10
ns
CS Pulse Width High
tCSPWH
20
ns
SCLK Rise to DOUT Fall
tSDL
Load capacitance = 20pF
50
ns
SCLK Rise to DOUT Rise
tSDH
Load capacitance = 20pF
50
ns
Note 1: Static accuracy tested without load.
Note 2: Linearity is tested within codes 73hex to F8Dhex.
Note 3: Gain and offset tested within codes 73hex to F8Dhex.
Note 4: Static accuracy specifications valid for VREF = 1.2V to VDD.
Note 5: Current scales linearly between these two extremes of VREF.
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PDF描述 |
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参数描述 |
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| MAX5306EUE-T | 功能描述:数模转换器- DAC RoHS:否 制造商:Texas Instruments 转换器数量:1 DAC 输出端数量:1 转换速率:2 MSPs 分辨率:16 bit 接口类型:QSPI, SPI, Serial (3-Wire, Microwire) 稳定时间:1 us 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:SOIC-14 封装:Tube |
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