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参数资料
| 型号： | MB89PV630-101C |
| 厂商： | FUJITSU LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 10 MHz, MICROCONTROLLER, CDIP64 |
| 封装： | 1.778 MM PITCH, CERAMIC, DIP-64 |
| 文件页数： | 31/60页 |
| 文件大小： | 1472K |
| 代理商： | MB89PV630-101C |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页当前第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页
MB89630R Series
DS07-12531-4E
37
(7) Bus Write Timing
(VCC = 5.0 V
±10%, FCH = 10 MHz, AVSS = VSS= 0.0 V, TA = –40
°C to +85°C)
*1: For information on tinst, see “(4) Instruction Cycle”.
*2: This characteristics are also applicable to the bus read timing.
Parameter
Symbol
Pin name
Condition
Value
Unit Remarks
Min.
Max.
Valid address
→ ALE ↓ time tAVLL
AD7 to AD0,
ALE
A15 to A08
—
1/4 tinst*1 – 64 ns*2
—
μs
ALE
↓ time → address loss
time
tLLAX
5—
ns
Valid address
→ WR ↓ time tAVWL
WR, ALE
1/4 tinst*1 – 60 ns*2
—
μs
WR pulse width
tWLWH
WR
1/2 tinst*1 – 20 ns*2
—
μs
Write data
→ WR ↑ time
tDVWH
AD7 to AD0, WR
1/2 tinst*1 – 60 ns*2
—
μs
WR
↑ → address loss time
tWHAX
WR, A15 to A08
1/4 tinst*1 – 40 ns*2
—
μs
WR
↑ → data hold time
tWHDX
AD7 to AD0, WR
1/4 tinst*1 – 40 ns*2
—
μs
WR
↑ → ALE ↑ time
tWHLH
WR, ALE
1/4 tinst*1 – 40 ns*2
—
μs
WR
↓ → CLK ↑ time
tWLCH
WR, CLK
1/4 tinst*1 – 40 ns*2
—
μs
CLK
↓ → WR ↑ time
tCLWH
0—
ns
ALE pulse width
tLHLL
ALE
1/4 tinst*1 – 35 ns*2
—
μs
ALE
↓ → CLK ↑ time
tLLCH
ALE,CLK
1/4 tinst*1 – 30 ns*2
—
μs
A15 to A08
AD7 to AD0
ALE
CLK
WR
0.8V
0.8 V
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
tCLWH
0.8 V
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
tLLAX
tLHLL
tLLCH
tAVLL
tDVWH
tWHDX
tWHAX
tWLCH
tAVWL
tWHLH
tWLWH
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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