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参数资料
| 型号： | MB90F342CEPMC |
| 厂商： | FUJITSU LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 1.70 MM HEIGHT, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件页数： | 62/92页 |
| 文件大小： | 2532K |
| 代理商： | MB90F342CEPMC |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页
MB90340E Series
DS07-13747-4E
65
(9) LIN-UART0/1/2/3
Bit setting: ESCR:SCES = 0, ECCR:SCDE = 0
(TA
= 40 °C to +105 °C, VCC = 5.0 V ± 10%, fCP ≤ 24 MHz, VSS = 0 V)
Notes :
AC characteristic in CLK synchronized mode.
CL is load capacity value of pins when testing.
tCP is internal operating clock cycle time (machine clock) . Refer to “ (1) Clock Timing”.
Parameter
Symbol
Pin
Condition
Value
Unit
Min
Max
Serial clock cycle time
tSCYC
SCK0 to SCK3
Internal shift clock
mode output pins are
CL
= 80 pF + 1 TTL.
5 tCP
ns
SCK
↓ → SOT delay time
tSLOVI
SCK0 to SCK3,
SOT0 to SOT3
50
+50
ns
Valid SIN
→ SCK ↑
tIVSHI
SCK0 to SCK3,
SIN0 to SIN3
tCP + 80
ns
SCK
↑ → Valid SIN hold time
tSHIXI
SCK0 to SCK3,
SIN0 to SIN3
0
ns
Serial clock “L” pulse width
tSHSL
SCK0 to SCK3
External shift clock
mode output pins are
CL
= 80 pF + 1 TTL.
3 tCP - tR
ns
Serial clock “H” pulse width
tSLSH
SCK0 to SCK3
tCP + 10
ns
SCK
↓ → SOT delay time
tSLOVE
SCK0 to SCK3,
SOT0 to SOT3
2 tCP + 60
ns
Valid SIN
→ SCK ↑
tIVSHE
SCK0 to SCK3,
SIN0 to SIN3
30
ns
SCK
↑ → Valid SIN hold time
tSHIXE
SCK0, SCK1,
SIN0 to SIN3
tCP + 30
ns
SCK fall time
tF
SCK0 to SCK3
10
ns
SCK rise time
tR
SCK0 to SCK3
10
ns
SCK0 to SCK3
2.4 V
0.8 V
SOT0 to SOT3
0.8 V
2.4 V
0.8 V
tSLOVI
SIN0 to SIN3
VIL
VIH
VIL
VIH
tSCYC
tIVSHI
tSHIXI
Internal Shift Clock Mode
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PDF描述 |
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