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参数资料
| 型号： | MB90F457PMT |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP48 |
| 封装： | 0.50 MM PITCH, PLASTIC, LQFP-48 |
| 文件页数： | 60/78页 |
| 文件大小： | 680K |
| 代理商： | MB90F457PMT |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页当前第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页
MB90455 Series
63
(4) UART timing
(VCC
= 4.5 V to 5.5 V, VSS = 0.0 V, TA = 40 °C to +105 °C)
* : Refer to "(1) Clock timing" ratings for tCP (internal operation clock cycle time).
Notes:
AC rating in CLK synchronous mode.
CL is a load capacitance value on pins for testing.
Parameter
Symbol Pin name
Conditions
Value
Unit Remarks
Min
Max
Serial clock cycle time
tSCYC
SCK1
Internal shift clock
mode output pin is :
CL
= 80 pF+1TTL.
8 tCP *
ns
SCK
↓ → SOT delay time
tSLOV
SCK1,
SOT1
80
+80
ns
Valid SIN
→ SCK ↑
tIVSH
SCK1,
SIN1
100
ns
SCK
↑ → valid SIN hold time
tSHIX
SCK1,
SIN1
60
ns
Serial clock “H” pulse width
tSHSL
SCK1
External shift clock
mode output pin is :
CL
= 80 pF+1TTL.
4 tCP *
ns
Serial clock “L” pulse width
tSLSH
SCK1
4 tCP *
ns
SCK
↓ → SOT delay time
tSLOV
SCK1,
SOT1
150
ns
Valid SIN
→ SCK ↑
tIVSH
SCK1,
SIN1
60
ns
SCK
↑ →valid SIN hold time
tSHIX
SCK1,
SIN1
60
ns
相关PDF资料 |
PDF描述 |
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参数描述 |
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