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参数资料
| 型号： | MB96F348HSBPMC-GSE2 |
| 厂商： | Fujitsu Semiconductor America Inc |
| 文件页数： | 116/118页 |
| 文件大小： | 0K |
| 描述： | IC MCU 544KB FLASH/ROM 100LQFP |
| 标准包装： | 1 |
| 系列： | F²MC MB96340 |
| 核心处理器： | F²MC-16FX |
| 芯体尺寸： | 16-位 |
| 速度： | 56MHz |
| 连通性： | CAN，EBI/EMI，I²C，LIN，SCI，UART/USART |
| 外围设备： | DMA，LVD，LVR，POR，PWM，WDT |
| 输入/输出数： | 82 |
| 程序存储器容量： | 544KB（544K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 24K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 数据转换器： | A/D 24x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 100-LQFP |
| 包装： | 托盘 |
| 配用： | 865-1100-ND - KIT BUNDLE 100PMC KIT/SOFTWARE |
| 其它名称： | 865-1085 |
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Specication
MB96340
FME/EMDC- 2007-9-12
MB96300_DS_el_AC_i2c.fm
95
PRELIMINARY
I2C Timing
(TA = -40C to 125C, VCC = AVCC= 3.0V to 5.5V, VSS = AVSS = 0V)
*1 : R,C : Pull-up resistor and load capacitor of the SCL and SDA lines.
*2 : The maximum tHDDAT have only to be met if the device does not stretch the “L” width (tLOW) of the SCL signal.
*3 : A Fast-mode I2C-bus device can be used in a Standard-mode I2C-bus system, but the requirement
tSUDAT
≥ 250 ns must then be met.
*4 : For use at over 100 kHz, set the peripheral clock 1 to at least 6 MHz.
Parameter
Symbol
Condition
Standard-mode
Fast-mode*4
Unit
Min
Max
Min
Max
SCL clock frequency
fSCL
R
= 1.7 k,
C
= 50 pF*1
0
100
0
400
kHz
Hold time (repeated) START condition
SDA
↓→SCL↓
tHDSTA
4.0
0.6
s
“L” width of the SCL clock
tLOW
4.7
1.3
s
“H” width of the SCL clock
tHIGH
4.0
0.6
s
Set-up time for a repeated START condition
SCL
↑→SDA↓
tSUSTA
4.7
0.6
s
Data hold time
SCL
↓→SDA↓↑
tHDDAT
0
3.45*2
0
0.9*3
s
Data set-up time
SDA
↓↑→SCL↑
tSUDAT
250
100
ns
Set-up time for STOP condition
SCL
↑→SDA↑
tSUSTO
4.0
0.6
s
Bus free time between a STOP and START
condition
tBUS
4.7
1.3
s
SDA
SCL
tLOW
tSUDAT
tHDSTA
tBUS
tHDSTA
tHDDAT
tHIGH
tSUSTA
tSUSTO
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