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参数资料
| 型号： | MC-4516DA727XFA-A75 |
| 厂商： | ELPIDA MEMORY INC |
| 元件分类： | DRAM |
| 英文描述： | 16 M-WORD BY 72-BIT SYNCHRONOUS DYNAMIC RAM MODULE REGISTERED TYPE |
| 中文描述： | 16M X 72 SYNCHRONOUS DRAM MODULE, 5.4 ns, DMA168 |
| 封装： | DIMM-168 |
| 文件页数： | 9/14页 |
| 文件大小： | 179K |
| 代理商： | MC-4516DA727XFA-A75 |
EOL
Product
Data Sheet E0278N20 (Ver. 2.0)
4
MC-4516DA727XFA
Block Diagram
RDQMB0
/RCS0
RDQMB2
DQM
D0
/CS
DQ 0
DQ 1
DQ 2
DQ 3
DQ 4
DQ 5
DQ 6
DQ 7
DQ 6
DQ 5
DQ 4
DQ 3
DQ 2
DQ 1
DQ 0
D1
DQM
/CS
DQ 8
DQ 9
DQ 10
DQ 11
DQ 12
DQ 13
DQ 14
DQ 15
D2
DQM
/CS
DQ 32
DQ 33
DQ 34
DQ 35
DQ 36
DQ 37
DQ 38
DQ 39
DQ 2
DQ 0
DQ 7
DQ 5
DQ 3
DQ 1
DQ 6
DQ 4
D3
DQM
/CS
DQ 40
DQ 41
DQ 42
DQ 43
DQ 44
DQ 45
DQ 46
DQ 47
D4
DQM
/CS
D7
DQM
/CS
DQ 56
DQ 57
DQ 58
DQ 59
DQ 60
DQ 61
DQ 62
DQ 63
D8
DQM
/CS
D6
DQM
/CS
DQ 48
DQ 49
DQ 50
DQ 51
DQ 52
DQ 53
DQ 54
DQ 55
DQM
D5
/CS
DQ 24
DQ 25
DQ 26
DQ 27
DQ 28
DQ 29
DQ 30
DQ 31
CB 0
CB 1
CB 2
CB 3
CB 4
CB 5
CB 6
CB 7
DQ 16
DQ 17
DQ 18
DQ 19
DQ 20
DQ 21
DQ 22
DQ 23
RDQMB1
RDQMB4
RDQMB5
RDQMB7
RDQMB6
RDQMB3
SERIAL PD
SDA
A0
A1
A2
SA0 SA1 SA2
VCC
VSS
D0 - D8,
Register1, Register2, PLL
D0 - D8,
Register1, Register2, PLL
C
/CS0
DQMB0, 1, 4, 5
/RAS
/CAS
/WE
A0 - A9
/RRAS
/RCAS
/RWE
/CS2
DQMB2, 3, 6, 7
CKE0
A10, A11, BA0, BA1
REGE
/LE
RCKE0
RA10, RA11,
RBA0, RBA1
CLK1 - CLK3
12 pF
10
DQ 7
10
10
10
10
10
10
10
10
10
Register1
Register2
/RCS2
30 pF
15 pF
30 pF
15 pF
DQ 7
DQ 6
DQ 5
DQ 4
DQ 3
DQ 2
DQ 1
DQ 0
DQ 1
DQ 2
DQ 3
DQ 4
DQ 5
DQ 6
DQ 7
DQ 0
DQ 1
DQ 2
DQ 3
DQ 4
DQ 5
DQ 6
DQ 7
DQ 6
DQ 5
DQ 4
DQ 3
DQ 2
DQ 1
DQ 0
DQ 7
DQ 6
DQ 5
DQ 4
DQ 3
DQ 2
DQ 1
DQ 0
DQ 1
DQ 2
DQ 3
DQ 4
DQ 5
DQ 6
DQ 7
DQ 0
DQ 1
DQ 2
DQ 3
DQ 4
DQ 5
DQ 6
DQ 7
10 k
VCC
SCL
CLK0
10
CLK : D2,D3,D6
CLK : D4,D7,D8
CLK : Register 1,
Register 2
PLL
CLK : D0,D1,D5
RA0 - RA9
/RAS : D0 - D8
/CAS : D0 - D8
/WE : D0 - D8
A0 - A9 : D0 - D8
CKE : D0 - D8
A10, A11,
BA0, BA1 : D0 - D8
/RCS2
RDQMB2, 3, 6, 7
15 pF
/RCS0
RDQMB0, 1, 4, 5
15 pF
WP
47 k
MC-4516DA727XFB
have no this circuit.
Remarks 1. The value of all resistors of DQs is 10
.
2. D0 - D8:
PD45128841 (4M words × 8 bits × 4 banks)
3. REGE
≤ VIL: Buffer mode
REGE
≥ VIH: Register mode
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