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参数资料
| 型号： | MC10E193FNR2 |
| 厂商： | ON SEMICONDUCTOR |
| 元件分类： | 算术逻辑单元 |
| 英文描述： | 10E SERIES, 8-BIT ERROR DETECT AND CORRECT CKT, PQCC28 |
| 封装： | PLASTIC, LCC-28 |
| 文件页数： | 2/8页 |
| 文件大小： | 69K |
| 代理商： | MC10E193FNR2 |
MC10E193, MC100E193
http://onsemi.com
2
PIN DESCRIPTION
PIN
FUNCTION
B0–B6
ECL Bit Inputs
P1–P5
ECL Parity Outputs
PARERR, PARERR
ECL Parity Error Outputs
PGEN
ECL Word Parity Generator Output
CLK
ECL Clock Input
SHIFT
ECL Shift Input (Active–High)
S–IN
ECL Serial Data Input
HOLD
ECL Hold (Active–Low)
EN
ECL Enable (Active–Low)
EV/DD
ECL Even/Odd Contact
BPAR
ECL Bit Parity Gate Input
VCC, VCCO
Positive Supply
VEE
Negative Supply
NC
No Connect
Pinout: 28-Lead PLCC
(Top View)
B4
B5
B6
P2
PGEN
CLK
SHIFT
S-IN
HOLD
EN
EV/OD
BPAR
B0
VEE
B1
B2
B3
26
27
28
2
3
4
25
24
23
22
21
20
19
18
17
16
15
14
13
12
11
567
89
10
VCCO
PARERR
VCC
P5
VCCO
P4
P3
VCCO P1
B7
1
* All VCC and VCCO pins are tied together on the die.
LOGIC DIAGRAM AND PINOUT ASSIGNMENT
Warning: All VCC, VCCO, and VEE pins must be externally
connected to Power Supply to guarantee proper operation.
LOGIC DIAGRAM
B INPUTS
0 3 6 574 2 1
B2, B3, B6, B7
B1, B3, B5, B7
B4, B5, B6, B7
B1, B2, B4, B7
P2
P1
P3
P4
P5
PGEN
BYTE (B0 –B7)
PARERR
BPAR
EV/OD
EN
HOLD
S-IN
SHIFT
CLK
0
1
0
1
D
相关PDF资料 |
PDF描述 |
|---|---|
| MC10E336FNR2 | 10E SERIES, 3-BIT REGISTERED TRANSCEIVER, INVERTED OUTPUT, PQCC28 |
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| MC10E337FNR2 | 10E SERIES, 3-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, PQCC28 |
| MC10E411FNR2 | 10E SERIES, LOW SKEW CLOCK DRIVER, 9 TRUE OUTPUT(S), 9 INVERTED OUTPUT(S), PQCC28 |
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相关代理商/技术参数 |
参数描述 |
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| MC10E196 B29M WAF | 制造商:ON Semiconductor 功能描述: |
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