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参数资料
| 型号： | MC10XS3435DPNAR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 19/51页 |
| 文件大小： | 0K |
| 描述： | IC SWITCH HIGH SIDE QUAD 24QFN |
| 标准包装： | 1,200 |
| 类型： | 高端开关 |
| 输出数： | 4 |
| Rds（开）： | 2 x 10 毫欧，2 x 35 毫欧 |
| 内部开关： | 是 |
| 电流限制： | 5A |
| 输入电压： | 4 V ~ 28 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-PowerQFN |
| 供应商设备封装： | 24-PQFN（12x12） |
| 包装： | 带卷 (TR) |
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ELECTRICAL CHARACTERISTICS
DYNAMIC ELECTRICAL CHARACTERISTICS
Table 5. Dynamic Electrical Characteristics (continued)
Characteristics noted under conditions 6.0 V ≤ V PWR ≤ 20 V, 3.0 V ≤ V DD ≤ 5.5 V, - 40 ° C ≤ T A ≤ 125 ° C, GND = 0 V unless
otherwise noted. Typical values noted reflect the approximate parameter means at T A = 25°C under nominal conditions unless
otherwise noted.
Characteristic
Symbol
Min
Typ
Max
Unit
PWM MODULE TIMING
Input PWM Clock Range on IN0
Input PWM Clock Low Frequency Detection Range on IN0 (36)
Input PWM Clock High Frequency Detection Range on IN0 (36)
Output PWM Frequency Range using external clock on IN0
Output PWM Frequency Accuracy using Calibrated Oscillator
Default Output PWM Frequency using Internal Oscillator
CS Calibration Low Minimum Time Detection Range
CS Calibration Low Maximum Tine Detection Range
f IN0
f IN0(LOW)
f IN0(HIGH)
f PWM
A FPWM(CAL)
f PWM(0)
t CS(MIN)
t CS(MAX)
7.68
1.0
100
–
-10
84
14
140
–
2.0
–
–
–
120
20
200
30.72
4.0
400
1.0
+10
156
26
260
kHz
kHz
kHz
Hz
%
Hz
μ s
μ s
Output PWM Duty-Cycle Range for fpwm = 1.0 kHz for high speed slew rate (36) R PWM _1k
10
94
%
Output PWM Duty-Cycle Range for fpwm = 400 Hz (36)
Output PWM Duty-Cycle Range for fpwm = 200 Hz (36)
R PWM _400
R PWM _200
6.0
5.0
98
98
%
%
INPUT TIMING
Direct Input Toggle Time-out
t IN
175
250
325
ms
AUTORETRY TIMING
Autoretry Period
t AUTO
105
150
195
ms
TEMPERATURE ON THE GND FLAG
Thermal Prewarning Detection (37)
Analog Temperature Feedback at T A = 25°C with R CSNS =2.5 k Ω
Analog Temperature Feedback Derating with R CSNS =2.5 k Ω (38)
T OTWAR
T FEED
DT FEED
110
1.15
-3.5
125
1.20
-3.7
140
1.25
-3.9
°C
V
mV/°C
Notes
35. Clock Fail detector available for PWM_en bit is set to logic [1] and CLOCK_sel is set to logic [0].
36. The PWM ratio is measured at V HS = 50% of V PWR and for the default SR value. It is possible to put the device fully-on (PWM duty-cycle
100%) and fully-off (duty-cycle 0%). For values outside this range, a calibration is needed between the PWM duty-cycle programming
and the PWM on the output with R L = 5.0 Ω resistive load.
37.
38.
Typical value guaranteed per design.
Value guaranteed per statistical analysis.
10XS3435
Analog Integrated Circuit Device Data
Freescale Semiconductor
19
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PDF描述 |
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参数描述 |
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