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参数资料
| 型号： | MC14536BFL1 |
| 厂商： | ON SEMICONDUCTOR |
| 元件分类： | 时钟/数据恢复及定时提取 |
| 英文描述： | 1 TIMER(S), PROGRAMMABLE TIMER, PDSO16 |
| 封装： | EIAJ, PLASTIC, SOIC-16 |
| 文件页数： | 4/18页 |
| 文件大小： | 328K |
| 代理商： | MC14536BFL1 |
MC14536B
http://onsemi.com
12
Figure 10. Time Interval Configuration Using an External Clock, Reset,
and Output Monostable to Achieve a Pulse Output
(Divide–by–4 Configured)
NOTE: When Power is first applied to the device with the Reset input going high, Decode Out initializes low. Bringing the Reset
input low enables the chip’s internal counters. After Reset goes low, the 2n/2 negative transition of the clock input causes
Decode Out to go high. Since the Mono–In input is being used, the output becomes monostable. The pulse width of the
output is dependent on the external timing components. The second and all subsequent pulses occur at 2n x (the clock
period) intervals where n = the number of stages selected from the truth table.
PULSE
GEN.
CLOCK
8–BYPASS
A
B
C
D
RESET
SET
CLOCK INH
MONO–IN
CLOCK INH
IN1
VSS
DECODE OUT
OUT 2
OUT 1
8
16
+V
6
9
10
11
12
2
1
7
15
14
313
5
4
DECODE OUT
RESET
IN1
POWER UP
VDD
RX
CX
*tw ≈ .00247 RX CX0.85
tw in sec
RX in k
CX in pF
*tw
相关PDF资料 |
PDF描述 |
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| MC146823L | 24 I/O, PIA-GENERAL PURPOSE, CDIP40 |
| MC146823P | 24 I/O, PIA-GENERAL PURPOSE, PDIP40 |
相关代理商/技术参数 |
参数描述 |
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