参数资料
型号: MC33385
厂商: 飞思卡尔半导体(中国)有限公司
英文描述: QUAD LOW SIDE DRIVER(四低端驱动器)
中文描述: 四路,低侧驱动器(四低端驱动器)
文件页数: 4/11页
文件大小: 369K
代理商: MC33385
MC33385
MOTOROLA
4
MC33385
Turn OFF Delay
(NON = 50%, Vout = 0.1 * VBat)
(NON = 50%, Vout = 4V)
t
dOFFa
t
dOFFb
1
4.7
3
7.5
μ
s
μ
s
Undervoltage Protection
Max ON time after a output voltage ramp from 0V to 25V at V
cc
= 0V...Vccpro
t
rpON
100
μ
s
Matching Turn ON Delay
(NON = 50%, Vout = 0.9 * VBat)
t
mON
- 3
3
μ
s
Rise time Turn OFF
(10% - 90% of V
clp
)
t
rOFF
8.5
12
OUTPUTS REVERSE DIODE
Reverse Output Current
I
RD
2,5
A
Reverse Peakcurrent (Note 1 and 2)
I
RDP
5
A
Reverse Voltage Drop
- I
out
= - 5A
- I
out
= - 2,5A
V
RD1
V
RD2
1.0
0.85
1.7
1.7
V
V
POWERSTAGE PROTECTION
Short Current Limit
I
SCB
3.0
5
A
Short Circuit Delay Time
t
SCB
0.2
2
μ
s
V
cc
Undervoltage
V
ccmin
3.35
3.95
V
DIAGNOSTIC
Short to GND Threshold Voltage for I
OUT
2A
V
REF
0.390xVcc
0.435xVcc
V
Short to GND Filter Time
T
SCG
140
250
μ
s
Open Load Threshold Current
I
OL
10
50
mA
Open Load Filter Time
t
OL
140
250
μ
s
Pull-up Resistor
R
OL
2.0
8.0
k
Temperature Detection Threshold
T
OFF
155
185
°
C
NOTES 1&2:
For t
2ms. Max. reverse current is limited to - 10A (for all outputs together)
SERIAL DIAGNOSTIC LINK : Load Capacitor at SDI and SDO = 100pF
Clock Frequency (50% duty cycle)
fclk
3
MHz
Minimum Time CLK = HIGH
tclh
100
ns
Minimum Time CLK = LOW
tcll
100
ns
Propagation Delay (CLF Data at SDO valid)
tpcld
100
ns
NCS = LOW to Data at SDO Valid
tpcld
100
ns
CLK Low Before NCS Low
(Setup time CLK to NCS change H/L)
tsclch
100
ns
CLK Change L/H after NCS = Low
thclcl
100
ns
SDI Input Set up Time
(CLK change H/Lafter SDI data valid)
tscld
20
ns
SDI Input Hold Time (SDI data hold after CLK change H/L)
thcld
20
ns
CLK Low Before NCS High
tsclcl
150
ns
CLK High After NCS High
thclch
150
ns
ELECTRICAL CHARACTERISTICS
T
CASE
= - 40
°
up to + 125
°
C and V
CC
= 4.5V up to 5.5V
Parameters
Symbol
Min
Typ
Max
Unit
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述
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参数描述
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