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参数资料
| 型号： | MC33790DW |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 11/13页 |
| 文件大小： | 0K |
| 描述： | IC DSI 2-CHAN INTERFACE 16-SOIC |
| 标准包装： | 47 |
| 类型： | 分布式系统接口 |
| 输入类型： | 逻辑 |
| 输出类型： | 逻辑 |
| 接口： | SPI |
| 电流 - 电源： | 1mA |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 16-SOIC W |
| 包装： | 管件 |
Analog Integrated Circuit Device Data
Freescale Semiconductor
7
33790
ELECTRICAL CHARACTERISTICS
DYNAMIC ELECTRICAL CHARACTERISTICS
DYNAMIC ELECTRICAL CHARACTERISTICS
Table 5. Dynamic Electrical Characteristics
Characteristics noted under conditions 4.75 V
V
DD 5.25 V, 8.0 V VSUP 25.0 V, -40 C TJ 150 C, unless otherwise
noted.
Characteristic
Symbol
Min
Typ
Max
Unit
MICROCONTROLLER INTERFACE
Microcontroller Signal Cycle Time
tCYC
6.6
–
1000
s
Microcontroller Signal Low Time
tCYCL
2.0
–
667
s
Microcontroller Signal High Time
tCYCH
2.0
–
667
s
Microcontroller Signal Duty Cycle for Logic Zero
DCLO
30
33
36
%
Microcontroller Signal Duty Cycle for Logic One
DCHI
60.0
66.7
72.0
%
Microcontroller Signal Slew Time (6)
tSLEW
–
500
ns
Frame Start to Signal Delay Time
tDLY1
tcyc-0.1
tcyc
tcyc+0.1
s
Signal End to Frame End Delay Time
tDLY2
1.0
–
s
Rise Time (6)
tRISE
0
–
100
ns
Fall Time (6)
tFALL
0
–
100
ns
BUS TRANSMITTER
Idle to Frame and Frame to Idle Slew Rate
C
5.0 nF
tSLEW(FRAME)
3.0
6.0
10.0
V/
s
Signal High to Low and Signal Low to High Slew Rate
C
5.0 nF
tSLEW(SIGNAL)
3.0
4.5
8.0
V/
s
Data Valid (VSUPx = 25 V, CL 5.0 nF)
DSIxF, VIN(TH) to DSIxO = 5.3 V
DSIxS, VIN(TH) to DSIxO = 2.6 V
DSIxS, VIN(TH) to DSIxO = 3.4 V
DSIxF, VIN(TH) to DSIxO = 7.0 V
tDVLD1
tDVLD2
tDVLD3
tDVLD4
2.44
0.25
–
6.56
1.3
s
BUS RECEIVER
Receiver Delay Time
tDRH: I = IRH to DSIxR = 2.5 V
tDRL: I = IRH to DSIxR = 2.5 V
tDRH
tDRL
–
400
750
ns
Notes
6.
Slew times and rise and fall times between 10% and 90% of output high and low levels.
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