- 您现在的位置：买卖IC网 > PDF目录80476 > MC3S12XEP100F1CVL (FREESCALE SEMICONDUCTOR INC) 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PBGA208 PDF资料下载
参数资料
| 型号： | MC3S12XEP100F1CVL |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PBGA208 |
| 封装： | MAPBGA-208 |
| 文件页数： | 522/1324页 |
| 文件大小： | 8453K |
| 代理商： | MC3S12XEP100F1CVL |
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Chapter 6 Interrupt (S12XINTV2)
MC9S12XE-Family Reference Manual , Rev. 1.21
276
Freescale Semiconductor
Because of an order from the United States International Trade Commission, BGA-packaged product lines and partnumbers
indicated here currently are not available from Freescale for import or sale in the United States prior to September 2010
Figure 6-14. Interrupt Processing Example
6.5.3
Wake Up from Stop or Wait Mode
6.5.3.1
CPU Wake Up from Stop or Wait Mode
Every I bit maskable interrupt request which is congured to be handled by the CPU is capable of waking
the MCU from stop or wait mode. To determine whether an I bit maskable interrupts is qualied to wake
up the CPU or not, the same settings as in normal run mode are applied during stop or wait mode:
If the I bit in the CCR is set, all I bit maskable interrupts are masked from waking up the MCU.
An I bit maskable interrupt is ignored if it is congured to a priority level below or equal to the
current IPL in CCR.
I bit maskable interrupt requests which are congured to be handled by the XGATE module are not
capable of waking up the CPU.
The X bit maskable interrupt request can wake up the MCU from stop or wait mode at anytime, even if the
X bit in CCR is set. If the X bit maskable interrupt request is used to wake-up the MCU with the X bit in
the CCR set, the associated ISR is not called. The CPU then resumes program execution with the
instruction following the WAI or STOP instruction. This features works following the same rules like any
interrupt request, i.e. care must be taken that the X interrupt request used for wake-up remains active at
least until the system begins execution of the instruction following the WAI or STOP instruction;
otherwise, wake-up may not occur.
6.5.3.2
XGATE Wake Up from Stop or Wait Mode
Interrupt request channels which are congured to be handled by the XGATE module are capable of
waking up the XGATE module. Interrupt request channels handled by the XGATE module do not affect
the state of the CPU.
0
Reset
4
0
7
6
5
4
3
2
1
0
L4
7
0
4
L1 (Pending)
L7
L3 (Pending)
RTI
4
0
3
0
RTI
1
0
RTI
Stacked IPL
Processing Levels
IPL in CCR
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PDF描述 |
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参数描述 |
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