- 您现在的位置：买卖IC网 > PDF目录80476 > MC3S12XEP100F1CVL (FREESCALE SEMICONDUCTOR INC) 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PBGA208 PDF资料下载
参数资料
| 型号： | MC3S12XEP100F1CVL |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PBGA208 |
| 封装： | MAPBGA-208 |
| 文件页数： | 612/1324页 |
| 文件大小： | 8453K |
| 代理商： | MC3S12XEP100F1CVL |
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Chapter 10 XGATE (S12XGATEV3)
MC9S12XE-Family Reference Manual Rev. 1.21
Freescale Semiconductor
357
Because of an order from the United States International Trade Commission, BGA-packaged product lines and partnumbers
indicated here currently are not available from Freescale for import or sale in the United States prior to September 2010
10.3.1.1
XGATE Control Register (XGMCTL)
All module level switches and ags are located in the XGATE Module Control Register Figure 10-3.
Read: Anytime
Write: Anytime
Module Base +0x00000
15
14
13
12
11
10
9876543210
R
00000000
XGE
XGFRZ XGDBG XGSS XGFACT
0
XG
SWEF
XGIE
W
XGEM
XG
FRZM
XG
DBGM
XG
SSM
XG
FACTM
XG
SWEFM
XGIEM
Reset
0000000000000000
= Unimplemented or Reserved
Figure 10-3. XGATE Control Register (XGMCTL)
Table 10-2. XGMCTL Field Descriptions (Sheet 1 of 3)
Field
Description
15
XGEM
XGE Mask — This bit controls the write access to the XGE bit. The XGE bit can only be set or cleared if a "1" is
written to the XGEM bit in the same register access.
Read:
This bit will always read "0".
Write:
0 Disable write access to the XGE in the same bus cycle
1 Enable write access to the XGE in the same bus cycle
14
XGFRZM
XGFRZ Mask — This bit controls the write access to the XGFRZ bit. The XGFRZ bit can only be set or cleared
if a "1" is written to the XGFRZM bit in the same register access.
Read:
This bit will always read "0".
Write:
0 Disable write access to the XGFRZ in the same bus cycle
1 Enable write access to the XGFRZ in the same bus cycle
13
XGDBGM
XGDBG Mask — This bit controls the write access to the XGDBG bit. The XGDBG bit can only be set or cleared
if a "1" is written to the XGDBGM bit in the same register access.
Read:
This bit will always read "0".
Write:
0 Disable write access to the XGDBG in the same bus cycle
1 Enable write access to the XGDBG in the same bus cycle
12
XGSSM
XGSS Mask — This bit controls the write access to the XGSS bit. The XGSS bit can only be set or cleared if a
"1" is written to the XGSSM bit in the same register access.
Read:
This bit will always read "0".
Write:
0 Disable write access to the XGSS in the same bus cycle
1 Enable write access to the XGSS in the same bus cycle
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MC3S12XEP100F1CVLR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers |
| MC3S12XEP100F1MAAR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers |
| MC3S12XEP100F1MAGR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers |
| MC3S12XEP100F1MALR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers |
| MC3S12XEP100F1MVLR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers |
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