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参数资料
| 型号： | MC56F8025MLD |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | 10 X 10 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, ROHS COMPLIANT, MS-026BCB, LQFP-44 |
| 文件页数： | 152/161页 |
| 文件大小： | 2160K |
| 代理商： | MC56F8025MLD |
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56F8035/56F8025 Data Sheet, Rev. 6
90
Freescale Semiconductor
1 = The clock is enabled to the PWM module
6.3.10
Peripheral Clock Enable Register 1 (SIM_PCE1)
See Section 6.3.9 for general information about Peripheral Clock Enable registers.
Figure 6-11 Peripheral Clock Enable Register 1 (SIM_PCE1)
6.3.10.1
Reserved—Bit 15
This bit field is reserved. It must be set to 0.
6.3.10.2
Programmable Interval Timer 2 Clock Enable (PIT2)—Bit 14
0 = The clock is not provided to the PIT2 module (the PIT2 module is disabled)
1 = The clock is enabled to the PIT2 module
6.3.10.3
Programmable Interval Timer 1 Clock Enable (PIT1)—Bit 13
0 = The clock is not provided to the PIT1 module (the PIT1 module is disabled)
1 = The clock is enabled to the PIT1 module
6.3.10.4
Programmable Interval Timer 0 Clock Enable (PIT0)—Bit 12
0 = The clock is not provided to the PIT0 module (the PIT0 module is disabled)
1 = The clock is enabled to the PIT0 module
6.3.10.5
Reserved—Bits 11–4
This bit field is reserved. Each bit must be set to 0.
6.3.10.6
Quad Timer A, Channel 3 Clock Enable (TA3)—Bit 3
0 = The clock is not provided to the Timer A3 module (the Timer A3 module is disabled)
1 = The clock is enabled to the Timer A3 module
6.3.10.7
Quad Timer A, Channel 2 Clock Enable (TA2)—Bit 2
0 = The clock is not provided to the Timer A2 module (the Timer A2 module is disabled)
1 = The clock is enabled to the Timer A2 module
6.3.10.8
Quad Timer A, Channel 1 Clock Enable (TA1)—Bit 1
0 = The clock is not provided to the Timer A1 module (the Timer A1 module is disabled)
1 = The clock is enabled to the Timer A1 module
Base + $D
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
PIT2
PIT1
PIT0
0
TA3
TA2
TA1
TA0
Write
RESET
0
00
0
000
0
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