参数资料
型号: MC56F8025VLD
厂商: Freescale Semiconductor
文件页数: 117/161页
文件大小: 0K
描述: IC DSP 16BIT DUAL HARV 44-LQFP
标准包装: 800
系列: 56F8xxx
核心处理器: 56800E
芯体尺寸: 16-位
速度: 32MHz
连通性: I²C,LIN,SCI,SPI
外围设备: POR,PWM,WDT
输入/输出数: 35
程序存储器容量: 32KB(16K x 16)
程序存储器类型: 闪存
RAM 容量: 2K x 16
电压 - 电源 (Vcc/Vdd): 3 V ~ 3.6 V
数据转换器: A/D 8x12b,D/A 2x12b
振荡器型: 内部
工作温度: -40°C ~ 105°C
封装/外壳: 44-LQFP
包装: 托盘
Block Diagram
56F8035/56F8025 Data Sheet, Rev. 6
Freescale Semiconductor
59
5.4 Block Diagram
Figure 5-1 Interrupt Controller Block Diagram
5.5 Operating Modes
The ITCN module design contains two major modes of operation:
Functional Mode
The ITCN is in this mode by default.
Wait and Stop Modes
During Wait and Stop modes, the system clocks and the 56800E core are turned off. The ITCN will signal
a pending IRQ to the System Integration Module (SIM) to restart the clocks and service the IRQ. An IRQ
can only wake up the core if the IRQ is enabled prior to entering the Wait or Stop mode.
5.6 Register Descriptions
A register address is the sum of a base address and an address offset. The base address is defined at the
system level and the address offset is defined at the module level.
Priority
Level
2 -> 4
Decode
INT1
Priority
Level
2 -> 4
Decode
INT64
Level 0
64 -> 6
Priority
Encoder
any0
Level 3
64 -> 6
Priority
Encoder
any3
INT
VAB
IPIC
CONTROL
6
PIC_EN
IACK
SR[9:8]
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PDF描述
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