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参数资料
| 型号： | MC56F8245MLD |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 60 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | 10 X 10 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, MS-026BCB, LQFP-44 |
| 文件页数： | 25/88页 |
| 文件大小： | 4050K |
| 代理商： | MC56F8245MLD |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页当前第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页
Memory Maps
MC56F825x/MC56F824x Digital Signal Controller, Rev. 3
Freescale Semiconductor
31
4.3
Data Map
The MC56F825x/MC56F824x series contains dual access memory. It can be accessed from core primary data buses (XAB1,
CDBW, CDBR) and secondary data buses (XAB2, XDB2). Addresses in data memory are selected on the XAB1 and XAB2
buses. Byte, word, and long data transfers occur on the 32-bit CDBR and CDBW buses. A second 16-bit read operation can be
performed in parallel on the XDB2 bus.
Peripheral registers and on-chip JTAG/EOnCE controller registers are memory mapped into data memory access. A special
direct address mode is supported for accessing a first 64-location in data memory by using a single word instruction.
1 All addresses are 16-bit word addresses.
2 This RAM is shared with data space starting at address X: 0x00 0000. See Figure 7.
Table 9. Program Memory Map1 for 56F8245/46 at Reset
1 All addresses are 16-bit word addresses.
Begin/End Address
Memory Allocation
P: 0x1F FFFF
P: 0x00 8800
RESERVED
P: 0x00 8BFF
P: 0x00 8000
On-chip RAM2: 6 KB
2 This RAM is shared with data space starting at address X: 0x00 0000. See Figure 7.
P: 0x00 7FFF
P: 0x00 2000
Internal program flash: 48 KB
Interrupt vector table locates from 0x00 2000 to 0x00 2085
COP reset address = 0x00 2002
Boot location = 0x00 2000
P: 0x00 2000
P: 0x00 0000
RESERVED
Table 10. 56F8247 and 56F8255/56/57 Data Memory Map1
1 All addresses are 16-bit word addresses.
Begin/End Address
Memory Allocation
X:0xFF FFFF
X:0xFF FF00
EOnCE
256 locations allocated
X:0xFF FEFF
X:0x01 0000
RESERVED
X:0x00 FFFF
X:0x00 F000
On-chip peripherals
4096 locations allocated
X:0x00 EFFF
X:0x00 9000
RESERVED
X:0x00 8FFF
X:0x00 8000
On-chip data RAM alias
X:0x00 7FFF
X:0x00 1000
RESERVED
X:0x00 0FFF
X:0x00 0000
On-chip data RAM
8KB2
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