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参数资料
型号： MC56F8322MFAER2
厂商： FREESCALE SEMICONDUCTOR INC
元件分类： 数字信号处理
英文描述： 0-BIT, 120 MHz, OTHER DSP, PQFP48
封装： ROHS COMPLIANT, LQFP-48
文件页数： 19/136页
文件大小： 719K
代理商： MC56F8322MFAER2
Serial Peripheral Interface (SPI) Timing
56F8322 Technical Data, Rev. 16
Freescale Semiconductor
115
Preliminary
10.9 Serial Peripheral Interface (SPI) Timing
Table 10-18 SPI Timing1
1. Parameters listed are guaranteed by design.
Characteristic
Symbol
Min
Max
Unit
See Figure
Cycle time
Master
Slave
tC
50
—
ns
10-9, 10-10,
10-11, 10-12
Enable lead time
Master
Slave
tELD
—
25
—
ns
10-12
Enable lag time
Master
Slave
tELG
—
100
—
ns
10-12
Clock (SCK) high time
Master
Slave
tCH
17.6
25
—
ns
10-9, 10-10,
10-11, 10-12
Clock (SCK) low time
Master
Slave
tCL
16
16.67
—
ns
10-12
Data set up time required for inputs
Master
Slave
tDS
20
0
—
ns
10-9, 10-10,
10-11, 10-12
Data hold time required for inputs
Master
Slave
tDH
0
2
—
ns
10-9, 10-10,
10-11, 10-12
Access time (time to data active from high-impedance
state)
Slave
tA
4.8
15
ns
10-12
Disable time (hold time to high-impedance state)
Slave
tD
3.7
15.2
ns
10-12
Data Valid for outputs
Master
Slave (after enable edge)
tDV
—
4.5
20.4
ns
10-9, 10-10,
10-11, 10-12
Data invalid
Master
Slave
tDI
0
—
ns
10-9, 10-10,
10-11, 10-12
Rise time
Master
Slave
tR
—
11.5
10.0
ns
10-9, 10-10,
10-11, 10-12
Fall time
Master
Slave
tF
—
9.7
9.0
ns
10-9, 10-10,
10-11, 10-12
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