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参数资料
| 型号： | MC68020EH20E |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 24/306页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT 33MHZ 132-PQFP |
| 标准包装： | 36 |
| 系列： | M680x0 |
| 处理器类型： | M680x0 32-位 |
| 速度： | 20MHz |
| 电压： | 5V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 132-BQFP 缓冲式 |
| 供应商设备封装： | 132-PQFP（24.13x24.13） |
| 包装： | 托盘 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页当前第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页第237页第238页第239页第240页第241页第242页第243页第244页第245页第246页第247页第248页第249页第250页第251页第252页第253页第254页第255页第256页第257页第258页第259页第260页第261页第262页第263页第264页第265页第266页第267页第268页第269页第270页第271页第272页第273页第274页第275页第276页第277页第278页第279页第280页第281页第282页第283页第284页第285页第286页第287页第288页第289页第290页第291页第292页第293页第294页第295页第296页第297页第298页第299页第300页第301页第302页第303页第304页第305页第306页
9/29/95
SECTION 1: OVERVIEW
UM Rev.1.0
xvi
M68020 USER’S MANUAL
MOTOROLA
LIST OF ILLUSTRATIONS (Continued)
Figure
Page
Number
Title
Number
7-4
Coprocessor Address Map in MC68020/EC020 CPU Space .......................... 7-7
7-5
Coprocessor Interface Register Set Map .........................................................7-7
7-6
Coprocessor General Instruction Format (cpGEN) ..........................................7-8
7-7
Coprocessor Interface Protocol for General Category Instructions.................. 7-10
7-8
Coprocessor Interface Protocol for Conditional Category Instructions ............ 7-11
7-9
Branch on Coprocessor Condition Instruction Format (cpBcc.W) ................... 7-12
7-10
Branch on Coprocessor Condition Instruction Format (cpBcc.L) ..................... 7-12
7-11
Set on Coprocessor Condition Instruction Format (cpScc) .............................. 7-13
7-12
Test Coprocessor Condition, Decrement, and Branch
Instruction Format (cpDBcc)...........................................................................7-14
7-13
Trap on Coprocessor Condition Instruction Format (cpTRAPcc) ..................... 7-15
7-14
Coprocessor State Frame Format in Memory ..................................................7-17
7-15
Coprocessor Context Save Instruction Format (cpSAVE) ............................... 7-20
7-16
Coprocessor Context Save Instruction Protocol .............................................. 7-21
7-17
Coprocessor Context Restore Instruction Format (cpRESTORE) ................... 7-22
7-18
Coprocessor Context Restore Instruction Protocol ..........................................7-23
7-19
Control CIR Format ..........................................................................................7-25
7-20
Condition CIR Format ......................................................................................7-26
7-21
Operand Alignment for Operand CIR Accesses .............................................. 7-26
7-22
Coprocessor Response Primitive Format ........................................................ 7-28
7-23
Busy Primitive Format ......................................................................................7-30
7-24
Null Primitive Format........................................................................................ 7-31
7-25
Supervisor Check Primitive Format..................................................................7-33
7-26
Transfer Operation Word Primitive Format ......................................................7-33
7-27
Transfer from Instruction Stream Primitive Format ..........................................7-34
7-28
Evaluate and Transfer Effective Address Primitive Format.............................. 7-35
7-29
Evaluate Effective Address and Transfer Data Primitive Format ..................... 7-35
7-30
Write to Previously Evaluated Effective Address Primitive Format .................. 7-37
7-31
Take Address and Transfer Data Primitive Format ..........................................7-39
7-32
Transfer to/from Top of Stack Primitive Format ...............................................7-40
7-33
Transfer Single Main Processor Register Primitive Format ............................. 7-40
7-34
Transfer Main Processor Control Register Primitive Format ...........................7-41
7-35
Transfer Multiple Main Processor Registers Primitive Format ......................... 7-42
7-36
Register Select Mask Format ...........................................................................7-42
7-37
Transfer Multiple Coprocessor Registers Primitive Format.............................. 7-43
7-38
Operand Format in Memory for Transfer to –(An) ...........................................7-44
7-39
Transfer Status Register and ScanPC Primitive Format.................................. 7-44
7-40
Take Preinstruction Exception Primitive Format .............................................. 7-45
7-41
MC68020/EC020 Preinstruction Stack Frame ................................................. 7-46
7-42
Take Midinstruction Exception Primitive Format ..............................................7-47
7-43
MC68020/EC020 Midinstruction Stack Frame .................................................7-47
7-44
Take Postinstruction Exception Primitive Format.............................................7-48
F
re
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sc
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S
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ic
o
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c
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
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相关PDF资料 |
PDF描述 |
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| MC68020CEH16E | IC MPU 32BIT 33MHZ 132-PQFP |
| ASM22DREF | CONN EDGECARD 44POS .156 EYELET |
| HSM36DREI | CONN EDGECARD 72POS .156 EYELET |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC68020EH25E | 功能描述:微处理器 - MPU 32-BIT MPU RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
| MC68020EH25E | 制造商:Freescale Semiconductor 功能描述:Microprocessor |
| MC68020EH33E | 功能描述:微处理器 - MPU 32-BIT MPU RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
| MC68020FC16 | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:MICROPROCESSORS USERS MANUAL |
| MC68020FC20 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:The first full 32-bit implementation of the M68000 family of microprocessors from Motorola |
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