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参数资料
| 型号： | MC68HC05PD6 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | PLASTIC, TQFP-80 |
| 文件页数： | 156/165页 |
| 文件大小： | 841K |
| 代理商： | MC68HC05PD6 |
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GENERAL RELEASE SPECIFICATION
July 7, 1997
MOTOROLA
TIMER SYSTEM
MC68HC05PD6
9-18
REV 1.1
9.2.3 Output Compare Register 2 (OC2)
The OC2 register data is transferred to the buffer register when the CPU writes to
CNT2, when the CMP2 presets the CNT2, or when system reset.
When the OC2 buffer register matches the CNT2 register, the OC2F bit in the Tsr2
Register Is Set And Cnt2 Is Preset To $01.
9.2.4 Timer Counter 2 (CNT2)
The Timer Counter 2 (CNT2) is incremented by the falling edge of the timer clock
(which is synchronized and has the same timing as falling edge of PH2).
The CNT2 register is compared with OC2 buffer register and initialized to $01 if it
matches. It is also initialized to $01 on reset and any CPU write to this register.
The CPU read of this counter should be done while PH2 is high and data may be
latched by the local or main data bus while PH2 is low.
9.2.5 Time Base Control Register 1 (TBCR1)
TBCLK, LCLK
See Section 8.4 for a detailed description.
W
R
OC2
$001E
reset
2OC7
1
7
11
54
1
1111
6
3210
2OC6
2OC4
2OC5
2OC3
2OC2
2OC0
2OC1
W
R
CNT2
$001F
reset
2CNT7
0
7
00
54
0
0001
6
3210
2CNT6
2CNT4
2CNT5
2CNT3
2CNT2
2CNT0
2CNT1
Counter Preset to 1
W
R
TBCR1
$0010
reset
TBCLK
0
7
00
54
0
0000
6
3210
0
LCLK
0
T2R0
T2R1
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PDF描述 |
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