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参数资料
| 型号： | MC68HC08GP8AMFB |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | PLASTIC, QFP-44 |
| 文件页数： | 82/126页 |
| 文件大小： | 4243K |
| 代理商： | MC68HC08GP8AMFB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页当前第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页
Clock Generator Module (CGM)
CGM Registers
MC68HC08GP8A
Data Sheet
MOTOROLA
Clock Generator Module (CGM)
59
4.5.1 PLL Control Register
The PLL control register (PCTL) contains the interrupt enable and flag bits, the
on/off switch, the base clock selector bit, the prescaler bits, and the VCO
power-of-two range selector bits.
Addr.
Register Name
Bit 7
654321
Bit 0
$0036
PLL Control Register
(PCTL)
Read:
PLLIE
PLLF
PLLON
BCS
PRE1
PRE0
VPR1
VPR0
Write:
Reset:
00100000
$0037
PLL Bandwidth Control
Register (PBWC)
Read:
AUTO
LOCK
ACQ
0000
R
Write:
Reset:
00000000
$0038
PLL Multiplier Select High
Register (PMSH)
Read:
0000
MUL11
MUL10
MUL9
MUL8
Write:
Reset:
00000000
$0039
PLL Multiplier Select Low
Register (PMSL)
Read:
MUL7
MUL6
MUL5
MUL4
MUL3
MUL2
MUL1
MUL0
Write:
Reset:
01000000
$003A
PLL VCO Select Range
Register (PMRS)
Read:
VRS7
VRS6
VRS5
VRS4
VRS3
VRS2
VRS1
VRS0
Write:
Reset:
01000000
$003B
PLL Reference Divider
Select Register (PMDS)
Read:
0000
RDS3
RDS2
RDS1
RDS0
Write:
Reset:
00000001
NOTES:
1. When AUTO = 0, PLLIE is forced clear and is read-only.
2. When AUTO = 0, PLLF and LOCK read as clear.
3. When AUTO = 1, ACQ is read-only.
4. When PLLON = 0 or VRS7:VRS0 = $0, BCS is forced clear and is read-only.
5. When PLLON = 1, the PLL programming register is read-only.
6. When BCS = 1, PLLON is forced set and is read-only.
= Unimplemented
R
= Reserved
Figure 4-3. CGM I/O Register Summary
Address:
$0036
Bit 7
654321
Bit 0
Read:
PLLIE
PLLF
PLLON
BCS
PRE1
PRE0
VPR1
VPR0
Write:
Reset:
00100000
= Unimplemented
Figure 4-4. PLL Control Register (PCTL)
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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