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参数资料
| 型号： | MC68HC11F1VPU4 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | Technical Summary 8-Bit Microcontroller |
| 中文描述： | 8-BIT, EEPROM, 4 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, LQFP-80 |
| 文件页数： | 147/163页 |
| 文件大小： | 711K |
| 代理商： | MC68HC11F1VPU4 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页当前第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页
MOTOROLA
PARALLEL INPUT/OUTPUT
MC68HC11F1
6-4
TECHNICAL DATA
Bits [7:6] — Not implemented
Always read zero
DDD[5:0] — Data Direction for Port D
0 = Input
1 = Output
NOTE
When the SPI system is in slave mode, DDD5 has no meaning nor
effect. When the SPI system is in master mode, DDD5 determines
whether bit 5 of PORTD is an error detect input (DDD5 = 0) or a gen-
eral-purpose output (DDD5 = 1). If the SPI system is enabled and ex-
pects any of bits [4:2] to be an input, that bit will be an input
regardless of the state of the associated DDR bit. If any of bits [4:2]
are expected to be outputs that bit will be an output only if the asso-
ciated DDR bit is set.
6.5 Port E
Port E has eight general-purpose input pins and shares functions with the A/D convert-
er system. When some port E pins are being used for general-purpose input and oth-
ers are being used as A/D inputs, PORTE should not be read during the sample
portion of an A/D conversion.
6.6 Port F
Reset state is mode dependent. In single-chip or bootstrap modes, port F pins are gen-
eral-purpose outputs. In expanded and test modes, port F pins are low order address
outputs and PORTF is not in the memory map.
DDRD — Data Direction Register for Port D
$1009
Bit 7
654321
Bit 0
—
DDD5
DDD4
DDD3
DDD2
DDD1
DDD0
RESET:
0000000
0
PORTE — Port E Data
$100A
Bit 7
654321
Bit 0
PE7
PE6
PE5
PE4
PE3
PE2
PE1
PE0
RESET:
IIIIIII
I
Alt. Pin
Func.:
AN7
AN6
AN5
AN4
AN3
AN2
AN1
AN0
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