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参数资料
| 型号： | MC68HC11G7CFN |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
| 封装： | PLASTIC, LCC-84 |
| 文件页数： | 136/195页 |
| 文件大小： | 1940K |
| 代理商： | MC68HC11G7CFN |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页当前第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页
INPUT/OUTPUT PORTS
4-7
RESET:
$00 (all general purpose I/O configured for input only).
0 – Bits set to zero configure the corresponding I/O pins as inputs.
1 – Bits set to one configure the corresponding I/O pins as outputs.
Bit 5 of Port D is dedicated as the active low slave select (SS) input, when the SPI system is enabled.
In SPI slave mode, DDRD bit 5 has no meaning or effect. In SPI master mode, DDRD bit 5
determines whether Port D bit 5 is an error detect input to the SPI (DDRD bit clear) or a general
purpose output line (DDRD bit set).
For bits 2, 3, & 4 (MISO, MOSI, & SCK): if the SPI is enabled and expects the bit to be an input, it
will be an input regardless of the state of the DDRD bit; if the SPI is enabled and expects the bit to
be an output, it will be an output only if the DDRD bit is set.
4.8
PORT E
Port E is an 8-bit port which supports the 8-channel A/D converter. Any channels not used
for A/D may be used as general purpose inputs.
Since there is no output drive logic associated with Port E there is no DDRE register. Port E pins
are capable of withstanding negative 1 volt transients (current limited by an external 10 k
or greater
resistor) without affecting MCU operation, other than possible loss of the A/D input sample for a
conversion being performed at the time of the transient. Using Port E pins as A/D inputs does not
affect the ability to read these pins as static inputs. However, reading Port E during an A/D
conversion sequence may inject noise into the analog input signals and may result in reduced
accuracy of the A/D result. Note that performing a digital read of Port E, with levels other than VDD
or VSS on the Port E pins, will result in greater power dissipation during the read cycle.
4.8.1
Data Register (PORTE)
PE7
PE6
PE5
PE4
PE3
PE2
PE1
PE0
PORTE
$100A
7
6
5
4
3
2
1
0
U
RESET:
Alternate Pin Function:
AN7
AN6
AN5
AN4
AN3
AN2
AN1
AN0
READ:
Any time (returns sensed levels at Port E pins).
WRITE:
Has no meaning or effect.
RESET:
Does not affect this address.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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