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参数资料
| 型号： | MC68HC11G7CFN |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
| 封装： | PLASTIC, LCC-84 |
| 文件页数： | 175/195页 |
| 文件大小： | 1940K |
| 代理商： | MC68HC11G7CFN |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页当前第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页
PROGRAMMABLE TIMER
6-10
6.4.7
Output Compare 7/Input Capture 6 Register (TO7I6)
This is a shared register which acts as the output compare OC7 register or as the input capture IC6
register depending on the state of the I6/O7 bit in the TCTL4 register. This register is associated with
timer counter 2 and with Port J, bit 2.
BIT15
BIT14
BIT13
BIT12
BIT11
BIT10
BIT9
BIT8
TO7I6
$1056
7
6
5
4
3
2
1
0
RESET:
0
BIT7
BIT6
BIT5
BIT4
BIT3
BIT2
BIT1
BIT0
$1057
READ:
Any time.
WRITE:
Any time this register is configured for OC operation.
RESET:
$FFFF
There are both input control bits and output control bits associated with these functions. Only the bits
associated with the selected function (input or output) will affect the operation of the timer channel.
6.4.8
Output Compare 1 Action Mask Register (OC1M)
OC1M7
OC1M6
OC1M5
OC1M4
OC1M3
0
OC1M
$100C
7
6
5
4
3
2
1
0
RESET:
READ:
Any time (bits 2 through 0 always return 0).
WRITE:
Any time (writes to bits 2 through 0 have no meaning or effect).
RESET:
$00 (OC1 disconnected from Port A logic).
OC1M is used to specify which bits of Port A (I/O and timer port) are to be affected as a result of a
successful OC1 compare. The bits of OC1M correspond bit-for-bit with the bits of Port A. For each
bit to be affected by the successful OC1 compare, the corresponding bit in OC1M must be set to one.
Each Port A line associated with an OC1Mx bit which is set to one will be forced to be an output
regardless of the state of the associated DDRA bit. This does not change the state of the DDRA bit.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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