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参数资料
型号： MC68HC11PH8CFN3
厂商： FREESCALE SEMICONDUCTOR INC
元件分类： 微控制器/微处理器
英文描述： 8-BIT, MROM, 3 MHz, MICROCONTROLLER, PQCC84
封装： PLASTIC, LCC-84
文件页数： 136/264页
文件大小： 1469K
代理商： MC68HC11PH8CFN3
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MOTOROLA
11-10
MC68HC11PH8
CPU CORE AND INSTRUCTION SET
11
BHS (rel)
Branch if higher or same
C = 0 ?
REL
24
rr
3
BITA (opr)
Bit(s) test A with memory
A M
A
IMM
A
DIR
A
EXT
A
IND, X
A
IND, Y
85
95
B5
A5
18 A5
ii
dd
hh ll
ff
2
3
4
5
0
BITB (opr)
Bit(s) test B with memory
B M
B
IMM
B
DIR
B
EXT
B
IND, X
B
IND, Y
C5
D5
F5
E5
18 E5
ii
dd
hh ll
ff
2
3
4
5
0
BLE (rel)
Branch if
≤ zero
Z + (N
⊕ V) = 1 ?
REL
2F
rr
3
BLO (rel)
Branch if lower
C = 1 ?
REL
25
rr
3
BLS (rel)
Branch if lower or same
C + Z = 1 ?
REL
23
rr
3
BLT (rel)
Branch if < zero
N
⊕ V = 1 ?
REL
2D
rr
3
BMI (rel)
Branch if minus
N = 1 ?
REL
2B
rr
3
BNE (rel)
Branch if
≠ zero
Z = 0 ?
REL
26
rr
3
BPL(rel)
Branch if plus
N = 0 ?
REL
2A
rr
3
BRA (rel)
Branch always
1 = 1 ?
REL
20
rr
3
BRCLR(opr)
(msk)
(rel)
Branch if bit(s) clear
M mm = 0 ?
DIR
IND, X
IND, Y
13
1F
18 1F
dd mm rr
ff mm rr
6
7
8
BRN (rel)
Branch never
1 = 0 ?
REL
21
rr
3
BRSET(opr)
(msk)
(rel)
Branch if bit(s) set
M mm = 0 ?
DIR
IND, X
IND, Y
12
1E
18 1E
dd mm rr
ff mm rr
6
7
8
BSET (opr)
(msk)
Set bit(s)
M + mm
M
DIR
IND, X
IND, Y
14
1C
18 1C
dd mm
ff
mm
ff
mm
6
7
8
0
BSR (rel)
Branch to subroutine
see Figure 11-2
REL
8D
rr
6
BVC (rel)
Branch if overow clear
V = 0 ?
REL
28
rr
3
BVS (rel)
Branch if overow set
V = 1 ?
REL
29
rr
3
CBA
Compare A with B
A B
INH
11
2
CLC
Clear carry bit
0
C
INH
0C
2
0
CLI
Clear interrupt mask
0
I
INH
0E
2
0
CLR (opr)
Clear memory byte
0
M
DIR
IND, X
IND, Y
7F
6F
18 6F
hh ll
ff
6
7
0100
CLRA
Clear accumulator A
0
A
A
INH
4F
2
0100
CLRB
Clear accumulator B
0
B
B
INH
5F
2
0100
CLV
Clear overow ag
0
V
INH
0A
2
0
CMPA (opr)
Compare A with memory
A M
A
IMM
A
DIR
A
EXT
A
IND, X
A
IND, Y
81
91
B1
A1
18 A1
ii
dd
hh ll
ff
2
3
4
5
CMPB (opr)
Compare B with memory
B M
B
IMM
B
DIR
B
EXT
B
IND, X
B
IND, Y
C1
D1
F1
E1
18 E1
ii
dd
hh ll
ff
2
3
4
5
COM (opr)
Ones complement memory byte
$FF M
M
EXT
IND, X
IND, Y
73
63
18 63
hh ll
ff
6
7
01
COMA
Ones complement A
$FF A
A
A
INH
43
2
01
COMB
Ones complement B
$FF B
B
B
INH
53
2
01
Table 11-2 Instruction set (Sheet 2 of 6)
Mnemonic
Operation
Description
Addressing
mode
Instruction
Condition codes
Opcode
Operand
Cycles
S X H
I
N Z V C
TPG
218
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