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参数资料
| 型号： | MC68HC11PH8CFN3 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 3 MHz, MICROCONTROLLER, PQCC84 |
| 封装： | PLASTIC, LCC-84 |
| 文件页数： | 7/264页 |
| 文件大小： | 1469K |
| 代理商： | MC68HC11PH8CFN3 |
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MOTOROLA
5-12
MC68HC11PH8
SERIAL COMMUNICATIONS INTERFACE
5
5.6.5
SCSR2 — SCI status register 2
In the SCSR2 only bit 0 is used, to indicate receiver active. The other seven bits always read zero.
Bits [7:1] — Not implemented; always read zero
RAF — Receiver active ag (read only)
1 (set)
–
A character is being received.
0 (clear) –
A character is not being received.
5.6.6
SCDRH, SCDRL — SCI data high/low registers
SCDRH/SCDRL is a parallel register that performs two functions. It is the receive data register
when it is read, and the transmit data register when it is written. Reads access the receive data
buffer and writes access the transmit data buffer. Data received or transmitted is double buffered.
If the SCI is being used with 7 or 8-bit data, only SCDRL needs to be accessed. Note that if 9-bit
data format is used, the upper register should be written rst to ensure that it is transferred to the
transmitter shift register with the lower register.
R8 — Receiver bit 8
Ninth serial data bit received when SCI is congured for a nine data bit operation
T8 — Transmitter bit 8
Ninth serial data bit transmitted when SCI is congured for a nine data bit operation
Bits [5:0] — Not implemented; always read zero
R/T[7:0] — Receiver/transmitter data bits [7:0]
SCI data is double buffered in both directions.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
SCI1 status 2 (SCSR2)
$0075
0000000
RAF
0000 0000
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
SCI1 data high (SCDRH)
$0076
R8
T8
000000
undened
SCI1 data low (SCDRL)
$0077
R7T7
R6T6
R5T5
R4T4
R3T3
R2T2
R1T1
R0T0
undened
TPG
102
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