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参数资料
| 型号： | MC68HC705BS8FB |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.2 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | PLASTIC, QFP-44 |
| 文件页数： | 108/128页 |
| 文件大小： | 9691K |
| 代理商： | MC68HC705BS8FB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页当前第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
9-4
MC68HC05BS8
SYNC SIGNAL PROCESSOR
9
9.5
Sync Separation
Figure 9-2 is a block diagram of the Sync Separator which includes the duration counters for the
high and low pulses, a counter for the number of valid horizontal sync pulses, a register to hold
the number of horizontal lines per frame, a logic block for horizontal and vertical sync pulse
separation, a comparator, and a sync pulse insertion circuit.
The Low pulse duration counter examines the low pulse width of the incoming composite sync
signal. If it is within the horizontal sync pulse limit (8
s or 16 t
CYC), a horizontal sync pulse is
detected, and the horizontal line counter is advanced. If the low pulse is wider than the limit, a
vertical sync pulse is detected, and the content of the Horizontal line counter is loaded into the
Horizontal Line register. The Low pulse duration counter then resets the Horizontal line counter.
The High Pulse Duration Counter examines the high pulse width of the incoming composite sync
signal. If it is longer than a specic value (8
s or 16 t
CYC), the vertical sync pulse has nished and
a “nish” signal will be given to the Sync Separation Logic.
Sync Separation Logic passes the Csync signal to the Hsync output until there is an “equal” signal
from the comparator. The Hsync output will then output an reassembled waveform by the Sync
Insertion Circuit to emulate the Hsync pulses, and the Vsync output is set to “low” at the coming
falling edge of the Csync signal. After the “nish” signal has been sensed, the Vsync output is xed
to “high”, and the Hsync output follows the Csync input again.
Figure 9-2 Sync Separator
Sync separation logic
Sync insertion circuit
Comparator
Low pulse duration counter
High pulse duration counter
Horizontal Line Register
Horizontal Line counter
CLK
Csync
load
reset
count
in
out
equal
Hsync
Vsync
nish
Csync
Vertical
TPG
78
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC05BS8FB | 8-BIT, MROM, 2.2 MHz, MICROCONTROLLER, PQFP44 |
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