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参数资料
| 型号： | MC68HC705L5FUE |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | MROM, 4.2 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | PLASTIC, QFP-80 |
| 文件页数： | 30/200页 |
| 文件大小： | 941K |
| 代理商： | MC68HC705L5FUE |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页当前第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页
Timer System
Timer 2
MC68HC(7)05L5 — Rev. 2.0
General Release Specification
MOTOROLA
Timer System
125
NON-DISCLOSURE
AGREEMENT
REQUIRED
The CLK2 from the prescaler or the EXTCLK from the EVI block is
selected as timer clock by the T2CLK bit in the TCR2 register. The CLK2
and the EXCLK are synchronized to the falling edge of system clock in
the prescaler and the EVI blocks. The minimum pulse width of CLK2 is
the same as the system clock, and the minimum pulse width of EXCLK
(event mode) is one PH2 cycle. When the EXCLK (event mode) is
selected, 50% duty is not guaranteed.
The counter is incremented by the falling edge of the timer clock and the
period between two falling edges is defined as one timer cycle in the
following description.
The compare register (OC2) is provided for comparison with the timer
counter 2 (TCNT2). The OC2 data is transferred to the buffer register
when the counter is preset by a CPU write or by a compare output
(CMP2). This buffer register is compared with the timer counter 2
(TCNT2).
The comparison between the counter and the OC2 buffer register is
done when the system clock is high in each bus cycle. If the counter
matches with the OC2 buffer register, the comparator latches this result
during the current timer cycle. When the next timer cycle begins, the
comparator outputs CMP2 signal (if the compare match is detected
during previous timer cycle). This CMP2 is used in the counter preset
data transfer to the buffer register, setting OC2F in the TSR2 and the
EVO block. The counter preset overrides the counter increment.
The OC2F bit may generate interrupt requests if the OC2IE bit in the
TCR2 is set.
F
re
e
sc
a
le
S
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m
ic
o
n
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u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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