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参数资料
| 型号： | MC68HC711D3CFN2 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2 MHz, MICROCONTROLLER, PQCC44 |
| 封装： | PLASTIC, LCC-44 |
| 文件页数： | 18/138页 |
| 文件大小： | 1047K |
| 代理商： | MC68HC711D3CFN2 |
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Electrical Characteristics
MC68HC711D3 Data Sheet, Rev. 2.1
114
Freescale Semiconductor
9.7 Peripheral Port Timing
Figure 9-8. Port Write Timing Diagram
Figure 9-9. Port Read Timing Diagram
Characteristic(1)
1. VDD = 5.0 Vdc ± 10%, VSS = 0 Vdc, TA = TL to TH. All timing is shown with respect to 20% VDD and 70% VDD, unless
otherwise noted.
Symbol
1.0 MHz
2.0 MHz
3.0 MHz
Unit
Min
Max
Min
Max
Min
Max
Frequency of operation (E-clock frequency)
fO
1.0
2.0
3.0
MHz
E-clock period
tCYC
1000
—
500
—
333
—
ns
Peripheral data setup time(2)
MCU read of ports A, B, C, and D
2. Port C and D timing is valid for active drive (CWOM and DWOM bits not set in PIOC and SPCR registers respectively).
tPDSU
100
—
100
—
100
—
ns
Peripheral data hold time(2)
MCU read of ports A, B, C, and D
tPDH
50
—
50
—
50
—
ns
Delay time, peripheral data write
MCU write to port A
MCU writes to ports B, C, and D
tPWD = 1/4 tcyc + 150 ns
tPWD
—
200
350
—
200
225
—
200
183
ns
t PWD
E
MCU WRITE TO PORT
PREVIOUS PORT DATA
NEW DATA VALID
PORTS
B, C, D
PORT A
tPWD
tPDH
E
MCU READ OF PORT
tPDSU
PORTS
A, B, C, D
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