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参数资料
| 型号： | MC68HCL05C9AFB |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | QFP-44 |
| 文件页数： | 59/160页 |
| 文件大小： | 4128K |
| 代理商： | MC68HCL05C9AFB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页当前第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页
MC68HSC05C9A
MC68HC05C9A — Rev. 4.0
General Release Specification
MC68HSC05C9A
NON-DISCLOSURE
AGREEMENT
REQUIRED
Table B-7. High-Speed SPI Timing (V
DD = 2.4–3.6 Vdc)
Num
Characteristic
Symbol
Min
Max
Unit
Operating Frequency
Master
Slave
f
OP
(M)
f
OP
(S)
dc
0.5
2.1
f
OP
MHz
1
Cycle Time
Master
Slave
t
CYC
(M)
t
CYC
(S)
2.0
480
—
t
CYC
ns
2
Enable Lead Time
Master
Slave
t
LEAD
(M)
t
LEAD
(S)
240
—
ns
3
Enable Lag Time
Master
Slave
t
LAG
(M)
t
LAG
(S)
720
—
ns
4
Clock (SCK) High Time
Master
Slave
t
W
(SCKH)M
t
W
(SCKH)S
340
190
—
ns
5
Clock (SCK) Low Time
Master
Slave
t
W
(SCKL)M
t
W
(SCKL)S
340
190
—
ns
6
Data Setup Time (Inputs)
Master
Slave
t
SU
(M)
t
SU
(S)
100
—
ns
7
Data Hold Time (Inputs)
Master
Slave
t
H
(M)
t
H
(S)
100
—
ns
8
Slave Access Time (Time to Data Active from
High-Impedance State)
t
A
0
120
ns
9
Slave Disable Time (Hold Time to High-Impedance
State)
t
DIS
—
240
ns
10
Data
Master (Before Capture Edge)
Slave (After Enable Edge)
t
V
(M)
t
V
(S)
0.25
—
240
t
CYC
(M)
ns
11
Data Hold Time (Outputs)
Master (After Capture Edge)
Slave (After Enable Edge)
t
HO
(M)
t
HO
(S)
0.25
0
—
t
CYC
(M)
ns
12
Rise Time (20% V
DD to 70% VDD, CL = 200 pF)
SPI Outputs (SCK, MOSI, and MISO)
SPI Inputs (SCK, MOSI, MISO, and SS)
t
RM
t
RS
—
100
2.0
ns
s
13
Fall Time (70% V
DD to 20% VDD, CL = 200 pF)
SPI Outputs (SCK, MOSI, and MISO)
SPI Inputs (SCK, MOSI, MISO, and SS)
t
FM
t
FS
—
100
2.0
ns
s
Signal production depends on software.
Assumes 200 pF load on all SPI pins.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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