参数资料
型号: MC68HLC908JK3CP
厂商: FREESCALE SEMICONDUCTOR INC
元件分类: 微控制器/微处理器
英文描述: 8-BIT, FLASH, 4 MHz, MICROCONTROLLER, PDIP20
封装: PLASTIC, DIP-20
文件页数: 214/215页
文件大小: 2324K
代理商: MC68HLC908JK3CP
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Monitor ROM (MON)
Technical Data
MC68H(R)C08JL3 Rev. 4
98
Monitor ROM (MON)
MOTOROLA
9.4.1 Entering Monitor Mode
Table 9-1 shows the pin conditions for entering monitor mode. As
specified in the table, monitor mode may be entered after a POR and will
allow communication at 9600 baud provided one of the following sets of
conditions is met:
1. If IRQ1 = VDD + VHI:
OSC1 is 4.9125MHz
PTB3 = low
2. If IRQ1 = VDD + VHI:
OSC1 is 9.8304MHz
PTB3 = high
If VDD +VHI is applied to IRQ1 and PTB3 is low upon monitor mode entry
(Table 9-1 condition set 1), the bus frequency is a divide-by-two of the
clock input to OSC1. If PTB3 is high with VDD +VHI applied to IRQ1 upon
monitor mode entry (Table 9-1 condition set 2), the bus frequency is a
divide-by-four of the clock input to OSC1. Holding the PTB3 pin low
when entering monitor mode causes a bypass of a divide-by-two stage
at the internal clock circuit. In this event, the OSCOUT frequency is
Table 9-1. Monitor Mode Entry Requirements and Options
IRQ
1
PTB3
PTB2
PTB1
PTB0
Clock Source
and
Frequency
Bus
Frequency
Comments
V
DD + VHI
0011
OSC1 at
4.9152MHz
2.4576MHz
Bypasses RC oscillator (in
HRC08xxx); OSC1 input
must be x-tal oscillator or
external oscillator clock.
9600 baud communication
on PTB0. COP disabled.
V
DD + VHI
1011
OSC1 at
9.8304MHz
2.4576MHz
VDD
XXXX
X-tal or RC
oscillator at
desired frequency
XTALCLK ÷ 4
or
RCCLK ÷ 4
Enters User mode
Notes:
1. PTB3 = 0: Bypasses the divide-by-two prescaler to SIM.
The OSC1 clock must be 50% duty cycle for this condition.
2. XTALCLK is the X-tal oscillator output, for MC68HC08xxx. See Figure 8-1.
4. RCCLK is the RC oscillator output, for MC68HRC08xxx. See Figure 8-2.
5. See Table 18-4 for VDD + VHI voltage level requirements.
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PDF描述
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