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参数资料
| 型号： | MC68HLC908QT4FQ |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PQCC8 |
| 封装： | DFN-8 |
| 文件页数： | 80/186页 |
| 文件大小： | 2765K |
| 代理商： | MC68HLC908QT4FQ |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页当前第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页
Electrical Specifications
Data Sheet
MC68HLC908QY/QT Family — Rev. 2
170
Electrical Specifications
MOTOROLA
16.6 Control Timing
Figure 16-1. RST and IRQ Timing
Low-voltage inhibit reset, trip falling voltage (LVR)
VTRIPF
2.00
2.12
2.24
V
Low-voltage inhibit reset, trip rising voltage (LVR)
VTRIPR
2.04
2.18
2.30
V
Low-voltage inhibit reset/recover hysteresis
VHYS
—60
—
mV
Low-voltage detect, trip falling voltage (LVD)
VDTRIPF
2.20
2.32
2.44
V
Low-voltage detect, trip rising voltage (LVD)
VDTRIPR
2.21
2.33
2.45
V
Low-voltage detect reset/recover hysteresis
VDHYS
—10
—
mV
1. VDD = VDDMIN to VDDMAX, VSS = 0 Vdc, TA = TL to TH, unless otherwise noted.
2. Typical values reflect average measurements at VDD = 3.0 V, 25°C only.
3. Maximum is highest voltage that POR is guaranteed.
4. If minimum VDD is not reached before the internal POR reset is released, the LVI will hold the part in reset until minimum
VDD is reached.
5. RPU is measured at VDD = 3.0 V.
Characteristic(1)
Symbol
Min
Typ(2)
Max
Unit
Characteristic(1)
Symbol
Min
Max
Unit
Internal operating frequency
fOP (fBus)
—2
MHz
Internal clock period (1/fOP)tcyc
500
—
ns
RST input pulse width low
tRL
400
—
ns
IRQ interrupt pulse width low (edge-triggered)
tILIH
400
—
ns
IRQ interrupt pulse period
tILIL
Note(2)
—
tcyc
1. VDD >= 2.2 V, VSS = 0 Vdc; timing shown with respect to 20% VDD and 70% VDD unless otherwise noted.
2. The minimum period is the number of cycles it takes to execute the interrupt service routine plus 1 tcyc.
RST
IRQ
tRL
tILIH
tILIL
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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