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参数资料
| 型号： | MC68HSR705J1AP |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, MICROCONTROLLER, PDIP20 |
| 封装： | PLASTIC, DIP-20 |
| 文件页数： | 27/162页 |
| 文件大小： | 3213K |
| 代理商： | MC68HSR705J1AP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页当前第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页
Technical Data
MC68HC705J1A — Rev. 4.0
Electrical Specifications
Electrical Specifications
10.8 3.3-Volt DC Electrical Characteristics
Characteristic(1)
1. VDD = 3.3 Vdc ± 10%, VSS = 0 Vdc, TA = –40°C to +105°C, unless otherwise noted
Symbol
Min
Typ(2)
2. Typical values at midpoint of voltage range, 25
°C only
Max
Unit
Output voltage
ILoad = 10.0 A
ILoad = –10.0 A
VOL
VOH
—
VDD– 0.1
—
0.1
—
V
Output high voltage
(ILoad = –0.2 mA) PA0–PA7, PB0–PB5
VOH
VDD – 0.3
——
V
Output low voltage
(ILoad = 0.4 mA) PA0–PA3, PB0–PB5
(ILoad = 5.0 mA) PA4–PA7
VOL
——
0.3
V
Input high voltage
PA0–PA7, PB0–PB5, IRQ/VPP, RESET, OSC1
VIH
0.7
× V
DD
—
VDD
V
Input low voltage
PA0–PA7, PB0–PB5, IRQ/VPP, RESET, OSC1
VIL
VSS
—
0.2
× V
DD
V
Supply current
Run Mode(3)
Wait Mode(4)
Stop Mode(5)
25
°C
–40 to 105
°C
3. Run mode IDD is measured using external square wave clock source (fosc = 2.0 MHz); all inputs 0.2 V from rail; no dc loads;
less than 50 pF on all outputs; C
L = 20 pF on OSC2
4. Wait mode IDD: only timer system active. Wait mode is affected linearly by OSC2 capacitance. Wait mode is measured
with all ports configured as inputs; VIL = 0.2 V; VIH = VDD – 0.2 V. Wait mode IDD is measured using external square wave
clock source (fosc = 2.0 MHz); all inputs 0.2 V from rail; no dc loads; less than 50 pF on all outputs; CL = 20 pF on OSC2.
5. Stop mode IDD is measured with OSC1 = VSS. Stop mode IDD is measured with all ports configured as inputs; VIL = 0.2 V;
VIH = VDD – 0.2 V
IDD
—
1.2
0.25
0.1
1.0
4.0
1.5
5
10
mA
A
I/O ports hi-z leakage current
PA0–PA7, PB0–PB5 (without individual pulldown activated)
IIL
—
0.1
±1
A
Input pulldown current
PA0–PA7, PB0–PB5 (with individual pulldown activated)
IIL
12
30
100
A
Input pullup current
RESET
IIL
–10
–25
–45
A
Input current(6)
RESET, IRQ/VPP, OSC1
6. Only input high current rated to +1
A on RESET.
IIn
—
0.1
±1
A
Capacitance
Ports (as inputs or outputs)
RESET, IRQ/VPP, OSC1, OSC2
COut
CIn
—
12
8
pF
Crystal/ceramic resonator oscillator mode internal resistor
OSC1 to OSC2(7)
7. The Rosc value selected for RC oscillator versions of this device is unspecified. See Appendix C. MC68HSR705J1A for
additional information.
Rosc
1.0
2.0
3.0
M
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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