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参数资料
| 型号： | MC68MH360CVR25L |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 49/158页 |
| 文件大小： | 0K |
| 描述： | IC MPU QUICC 25MHZ 357-PBGA |
| 标准包装： | 44 |
| 系列： | M683xx |
| 处理器类型： | M683xx 32-位 |
| 速度： | 25MHz |
| 电压： | 5V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 357-BBGA |
| 供应商设备封装： | 357-PBGA（25x25） |
| 包装： | 托盘 |
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QMC Supplement
Figure C-4. FSC Generation from a 2.048-MHz Clock—Block
Diagram
Figure C-5. FSC Generation from a 2.048-MHz Clock—Timing
The S/T interface includes elastic buffers allowing continued operation under any phase
relationship between the IDL frame sync and the network. These buffers allow the frame
sync to wander with respect to the network up to 60
s peak-to-peak, exceeding the Q.502
requirements of 18
s peak-to-peak over a 24-hour period.
Figure C-6 shows a block diagram of the connection between four S/T interfaces and the
QUICC32. The diagram would be the same for up to 10 S/T interfaces.
256 Divider
Duty cycle
of 50%
2.048-MHz
8-KHz Clock
Duty cycle 50%
D
CLK
Q
D
CLK
Q
FSC
2.048-MHz
2.048-MHz
Flip-op 1
Flip-op 2
Clock
8-KHz Clock
2.048-MHz
Q Flip-op 1
Q Flip-op 2
FSC
8 KHz
Inverted Clock
Clock
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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