参数资料
型号: MC705X32VFUE
厂商: Freescale Semiconductor
文件页数: 185/232页
文件大小: 0K
描述: IC MCU 8BIT 32K FLASH 64-QFP
标准包装: 84
系列: HC05
核心处理器: HC05
芯体尺寸: 8-位
速度: 4MHz
连通性: CAN,SCI
外围设备: POR,WDT
输入/输出数: 24
程序存储器容量: 32KB(32K x 8)
程序存储器类型: OTP
EEPROM 大小: 256 x 8
RAM 容量: 528 x 8
电压 - 电源 (Vcc/Vdd): 4.5 V ~ 5.5 V
数据转换器: A/D 8x8b
振荡器型: 内部
工作温度: -40°C ~ 105°C
封装/外壳: 64-QFP
包装: 托盘
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MC68HC05X16
Rev. 1
INPUT/OUTPUT PORTS
4
Table 4-1 shows the effect of reading from or writing to an I/O pin in various circumstances. Note
that the read/write signal shown is internal and not available to the user.
4.2
Ports A and B
These ports are standard M68HC05 bidirectional I/O ports, each comprising a data register and a
data direction register.
Reset does not affect the state of the data register, but clears the data direction register, thereby
returning all port pins to input mode. Writing a ‘1’ to any DDR bit sets the corresponding port pin
to output mode.
Wired-OR interrupts are provided on all pins of port B. If WOIE is enabled, any combination of high
logic levels on port B pins which are programmed as inputs will trigger an external interrupt. See
Figure 4-1 Standard I/O port structure
Table 4-1 I/O pin states
R/W
DDRn
Action of MCU write to/read of data bit
0
The I/O pin is in input mode. Data is written into the output data latch.
0
1
Data is written into the output data latch, and output to the I/O pin.
1
0
The state of the I/O pin is read.
1
The I/O pin is in output mode. The output data latch is read.
Latched data
register bit
DDRn
DATA
Input
buffer
Output
buffer
O/P
data
buffer
M68HC05
inter
nal
connections
DDRn
DATA
I/O Pin
100
111
0
tristate
0
1
tristate
I/O
Pin
Output
Input
Data direction
register bit
54
F
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e
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Freescale Semiconductor, Inc.
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