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参数资料
| 型号： | MC705X32VFUE |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 228/232页 |
| 文件大小： | 0K |
| 描述： | IC MCU 8BIT 32K FLASH 64-QFP |
| 标准包装： | 84 |
| 系列： | HC05 |
| 核心处理器： | HC05 |
| 芯体尺寸： | 8-位 |
| 速度： | 4MHz |
| 连通性： | CAN，SCI |
| 外围设备： | POR，WDT |
| 输入/输出数： | 24 |
| 程序存储器容量： | 32KB（32K x 8） |
| 程序存储器类型： | OTP |
| EEPROM 大小： | 256 x 8 |
| RAM 容量： | 528 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 数据转换器： | A/D 8x8b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 64-QFP |
| 包装： | 托盘 |
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MC68HC05X16
6-7
PROGRAMMABLE TIMER
6
ICF2 — Input capture ag 2
This bit is set when a negative edge is detected by the input capture edge detector 2 at TCAP2;
an input capture interrupt will be generated if ICIE is set. ICF2 is cleared by reading the TSR and
then the input capture low register 2 ($1D).
1 (set)
–
A valid (negative) input capture has occurred.
0 (clear) –
No input capture has occurred.
OCF2 — Output compare ag 2
This bit is set when the output compare 2 register contents match those of the free-running
counter; an output compare interrupt will be generated if OCIE is set. OCF2 is cleared by reading
the TSR and then the output compare 2 low register ($1F).
1 (set)
–
A valid output compare has occurred.
0 (clear) –
No output compare has occurred.
6.3
Input capture
‘Input capture’ is a technique whereby an external signal is used to trigger a read of the free
running counter. In this way it is possible to relate the timing of an external signal to the internal
counter value, and hence to elapsed time.
There are two input capture registers: input capture register 1 (ICR1) and input capture register 2 (ICR2).
The same input capture interrupt enable bit (ICIE) is used for the two input captures.
6.3.1
Input capture register 1 (ICR1)
The two 8-bit registers that make up the 16-bit input capture register 1 are read-only, and are used
to latch the value of the free-running counter after the input capture edge detector circuit 1 senses
a valid transition at TCAP1. The level transition that triggers the counter transfer is dened by the
input edge bit (IEDG1). When an input capture 1 occurs, the corresponding ag ICF1 in TSR is set.
An interrupt can also accompany an input capture 1 provided the ICIE bit in TCR is set. The 8 most
signicant bits are stored in the input capture high 1 register at $14, the 8 least signicant bits in
the input capture low 1 register at $15.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Input capture high 1
$0014
Undened
Input capture low 1
$0015
Undened
93
F
re
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sc
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Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MC70645 | 制造商:SPC Multicomp 功能描述:PLUG, XLR, FREE, 3POLE 制造商:SPC Multicomp 功能描述:PLUG, XLR, FREE, 3POLE; Gender:Plug; No. of Contacts:3; Contact Termination:-; Connector Mounting:Cable; Connector Body Material:Metal; Cable Protector Material:PVC; Colour:Silver; Connector Colour:Natural; Connector Type:XLR; |
| MC70646 | 制造商:SPC Multicomp 功能描述:SOCKET XLR FREE 3POLE |
| MC707G | 制造商:Motorola Inc 功能描述: |
| MC707W01916 | 制造商:Motorola Inc 功能描述:707W01916 |
| MC71000 | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:Bluetooth Baseband Controller |
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