参数资料
型号: MC74HC4060ADR2
厂商: ON Semiconductor
文件页数: 8/13页
文件大小: 0K
描述: IC COUNTER OSC 14STAGE 16SOIC
标准包装: 1
系列: 74HC
逻辑类型: 二进制计数器
方向:
元件数: 1
每个元件的位元数: 14
复位: 异步
计数速率: 50MHz
触发器类型: 负边沿
电源电压: 2 V ~ 6 V
工作温度: -55°C ~ 125°C
安装类型: 表面贴装
封装/外壳: 16-SOIC(0.154",3.90mm 宽)
供应商设备封装: 16-SOIC
包装: 标准包装
产品目录页面: 1123 (CN2011-ZH PDF)
其它名称: MC74HC4060ADRODKR
MC74HC4060ADRODKR-ND
MC74HC4060ADROSDKR
MC74HC4060A
http://onsemi.com
4
DC CHARACTERISTICS (Voltages Referenced to GND)
Symbol
Unit
Guaranteed Limit
VCC
V
Condition
Parameter
Symbol
Unit
≤125°C
≤85°C
55 to 25°C
VCC
V
Condition
Parameter
VOL
Maximum LowLevel Output Voltage
(Q4Q10, Q12Q14)
Vin = VIH or VIL
|Iout| ≤ 20mA
2.0
4.5
6.0
0.1
V
Vin = VIH or VIL
|Iout| ≤ 2.4mA
|Iout| ≤ 4.0mA
|Iout| ≤ 5.2mA
3.0
4.5
6.0
0.26
0.33
0.40
VOH
Minimum HighLevel Output Voltage
(Osc Out 1, Osc Out 2)
Vin = VCC or GND
|Iout| ≤ 20mA
2.0
4.5
6.0
1.9
4.4
5.9
1.9
4.4
5.9
1.9
4.4
5.9
V
Vin =VCC or GND
|Iout| ≤ 0.7mA
|Iout| ≤ 1.0mA
|Iout| ≤ 1.3mA
3.0
4.5
6.0
2.48
3.98
5.48
2.34
3.84
5.34
2.20
3.70
5.20
VOL
Maximum LowLevel Output Voltage
(Osc Out 1, Osc Out 2)
Vin = VCC or GND
|Iout| ≤ 20mA
2.0
4.5
6.0
0.1
V
Vin =VCC or GND
|Iout| ≤ 0.7mA
|Iout| ≤ 1.0mA
|Iout| ≤ 1.3mA
3.0
4.5
6.0
0.26
0.33
0.40
Iin
Maximum Input Leakage Current
Vin = VCC or GND
6.0
±0.1
±1.0
mA
ICC
Maximum Quiescent Supply
Current (per Package)
Vin = VCC or GND
Iout = 0mA
6.0
4
40
160
mA
AC CHARACTERISTICS (CL = 50 pF, Input tr = tf = 6 ns)
Symbol
Parameter
VCC
V
Guaranteed Limit
Unit
55 to 25°C
≤85°C
≤125°C
fmax
Maximum Clock Frequency (50% Duty Cycle)
(Figures 1 and 4)
2.0
3.0
4.5
6.0
10
30
50
9.0
14
28
45
8.0
12
25
40
MHz
tPLH,
tPHL
Maximum Propagation Delay, Osc In to Q4*
(Figures 1 and 4)
2.0
3.0
4.5
6.0
300
180
60
51
375
200
75
64
450
250
90
75
ns
tPLH,
tPHL
Maximum Propagation Delay, Osc In to Q14*
(Figures 1 and 4)
2.0
3.0
4.5
6.0
500
350
250
200
750
450
275
220
1000
600
300
250
ns
tPHL
Maximum Propagation Delay, Reset to Any Q
(Figures 2 and 4)
2.0
3.0
4.5
6.0
195
75
39
33
245
100
49
42
300
125
61
53
ns
tPLH,
tPHL
Maximum Propagation Delay, Qn to Qn+1
(Figures 3 and 4)
2.0
3.0
4.5
6.0
75
60
15
13
95
75
19
16
125
95
24
20
ns
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