参数资料
型号: MC908KX8MDWER2
厂商: Freescale Semiconductor
文件页数: 132/210页
文件大小: 0K
描述: IC MCU 8K FLASH 4/8MHZ 16-SOICW
标准包装: 47
系列: HC08
核心处理器: HC08
芯体尺寸: 8-位
速度: 8MHz
连通性: SCI
外围设备: LVD,POR,PWM
输入/输出数: 13
程序存储器容量: 8KB(8K x 8)
程序存储器类型: 闪存
RAM 容量: 192 x 8
电压 - 电源 (Vcc/Vdd): 2.7 V ~ 5.5 V
数据转换器: A/D 4x8b
振荡器型: 内部
工作温度: -40°C ~ 125°C
封装/外壳: 16-SOIC(0.295",7.50mm 宽)
包装: 带卷 (TR)
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页当前第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页
Memory
MC68HC908KX8 MC68HC908KX2 MC68HC08KX8 Data Sheet, Rev. 2.1
28
Freescale Semiconductor
$0038
ICG Trim Register
(ICGTR)
Read:
TRIM7
TRIM6
TRIM5
TRIM4
TRIM3
TRIM2
TRIM1
TRIM0
Write:
Reset:
10000000
$0039
ICG Divider Control
Register (ICGDVR)
Read:
DDIV3
DDIV2
DDIV1
DDIV0
Write:
Reset:
0000
UUUU
$003A
ICG DCO Stage Control
Register (ICGDSR)
Read:
DSTG7
DSTG6
DSTG5
DSTG4
DSTG3
DSTG2
DSTG1
DSTG0
Write:
RRRRRRRR
Reset:
UUUUUUUU
$003B
Reserved
RRRRRRRR
$003C
Analog-to-Digital Status and
Control Register (ADSCR)
Read:
COCO
AIEN
ADCO
ADCH4
ADCH3
ADCH2
ADCH1
ADCH0
Write:
R
Reset:
00011111
$003D
Analog-to-Digital Data
Register (ADR)
Read:
AD7AD6
AD5AD4
AD3AD2
AD1AD0
Write:
RRRRRRRR
Reset:
Indeterminate after reset
$003E
Analog-to-Digital Input Clock
Register (ADCLK)
Read:
ADIV2
ADIV1
ADIV0
ADICLK
000
R
Write:
Reset:
00000000
$003F
Unimplemented
$FE00
SIM Break Status Register
(SBSR)(1)
Read:
000100
BW
0
Write:
RRRRRR
NOTE
R
Reset:
00010000
1. Writing a 0 clears BW.
$FE01
SIM Reset Status Register
(SRSR)
Read:
POR
0
COP
ILOP
ILAD
MENRST
LVI
0
Write:
POR:
10000000
$FE02
Break Auxiliary Register
(BRKAR)
Read:
0000000
BDCOP
Write:
Reset:
00000000
$FE03
SIM Break Flag Control
Register (SBFCR)
Read:
BCFE
RRRRRRR
Write:
Reset:
0
$FE04
Interrupt Status Register 1
(INT1)
Read:
IF6
IF5
IF4
IF3
IF2
IF1
0
Write:
RRRRRRRR
Reset:
00000000
Addr.
Register Name
Bit 7
654321
Bit 0
= Unimplemented
R
= Reserved
U = Unaffected
Figure 2-2. Control, Status, and Data Registers (Sheet 4 of 5)
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PDF描述
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