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参数资料
| 型号： | MC9328MX21SCVK |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 16/88页 |
| 文件大小： | 0K |
| 描述： | IC MCU I.MX21 266MHZ 289-MAPBGA |
| 标准包装： | 152 |
| 系列： | i.MX21 |
| 核心处理器： | ARM9 |
| 芯体尺寸： | 32-位 |
| 速度： | 266MHz |
| 连通性： | 1 线，EBI/EMI，I²C，IrDA，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 192 |
| 程序存储器类型： | ROMless |
| 电压 - 电源 (Vcc/Vdd)： | 1.45 V ~ 3.3 V |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 289-LFBGA |
| 包装： | 托盘 |
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Specifications
MC9328MX21S Technical Data, Rev. 1.3
Freescale Semiconductor
23
Figure 13. Sharp TFT Panel Timing
Table 17. Sharp TFT Panel Timing
Symbol
Description
Minimum
Value
Unit
T1
SPL/SPR pulse width
–
1
Ts
T2
End of LD of line to beginning of HSYN
1
HWAIT1+1
Ts
T3
End of HSYN to beginning of LD of line
4
HWAIT2 + 4
Ts
T4
CLS rise delay from end of LD of line
3
CLS_RISE_DELAY+1
Ts
T5
CLS pulse width
1
CLS_HI_WIDTH+1
Ts
T6
PS rise delay from CLS negation
0
PS_RISE_DELAY
Ts
T7
REV toggle delay from last LD of line
1
REV_TOGGLE_DELAY+1
Ts
Note:
Falling of SPL/SPR aligns with first LD of line.
Falling of PS aligns with rising edge of CLS.
REV toggles in every HSYN period.
D1
D2
D320
SCLK
LD
SPL_SPR
HSYN
CLS
PS
REV
XMAX
T2
D320
T1
T3
T5
T4
T7
T6
T2
T4
T7
Because
of
an
order
from
the
United
States
International
Trade
Commission,
BGA-packaged
product
lines
and
part
numbers
indicated
here
currently
are
not
available
from
Freescale
for
import
or
sale
in
the
United
States
prior
to
September
2010:
i.MX21
Product
Family
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PDF描述 |
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参数描述 |
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