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参数资料
| 型号： | MC9S12DJ64CPVE |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP112 |
| 封装： | LQFP-112 |
| 文件页数： | 80/128页 |
| 文件大小： | 1835K |
| 代理商： | MC9S12DJ64CPVE |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页当前第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
MC9S12DJ64 Device User Guide — V01.20
55
PJ7
KWJ7
SCL
TXCAN0
VDDX
PERJ/
PPSJ
Up
Port J I/O, Interrupt, SCL of IIC, TX of
CAN0
PJ6
KWJ6
SDA
RXCAN0
Port J I/O, Interrupt, SDA of IIC, RX of
CAN0
PJ[1:0]
KWJ[1:0]
—
Port J I/O, Interrupts
PK7
ECS
ROMCTL
—
VDDX
PUCR/
PUPKE
Up
Port K I/O, Emulation Chip Select,
ROM On Enable
PK[5:0]
XADDR[19:14]
—
Port K I/O, Extended Addresses
PM7
—
PERM/
PPSM
Disabled
Port M I/O
PM6
—
Port M I/O
PM5
TXCAN0
SCK
—
Port M I/O, TX of CAN0, SCK of SPI0
PM4
RXCAN0
MOSI
—
Port M I/O, RX of CAN0, MOSI of SPI0
PM3
TXCAN0
SS0
—
Port M I/O, TX of CAN0, SS of SPI0
PM2
RXCAN0
MISO0
—
Port M I/O, RX of CAN0, MISO of SPI0
PM1
TXCAN0
TXB
—
Port M I/O, TX of CAN0, RX of BDLC
PM0
RXCAN0
RXB
—
Port M I/O, RX of CAN0, RX of BDLC
PP7
KWP7
PWM7
—
PERP/
PPSP
Port P I/O, Interrupt, Channel 7 of
PWM
PP6
KWP6
PWM6
—
Port P I/O, Interrupt, PWM Channel 6
PP5
KWP5
PWM5
—
Port P I/O, Interrupt, PWM Channel 5
PP4
KWP4
PWM4
—
Port P I/O, Interrupt, PWM Channel 4
PP3
KWP3
PWM3
—
Port P I/O, Interrupt, PWM Channel 3
PP2
KWP2
PWM2
—
Port P I/O, Interrupt, PWM Channel 2
PP1
KWP1
PWM1
—
Port P I/O, Interrupt, PWM Channel 1
PP0
KWP0
PWM0
—
Port P I/O, Interrupt, PWM Channel 0
PS7
SS0
—
PERS/
PPSS
Up
Port S I/O, SS of SPI0
PS6
SCK0
—
Port S I/O, SCK of SPI0
PS5
MOSI0
—
Port S I/O, MOSI of SPI0
PS4
MISO0
—
Port S I/O, MISO of SPI0
PS3
TXD1
—
Port S I/O, TXD of SCI1
PS2
RXD1
—
Port S I/O, RXD of SCI1
PS1
TXD0
—
Port S I/O, TXD of SCI0
PS0
RXD0
—
Port S I/O, RXD of SCI0
PT[7:0]
IOC[7:0]
—
PERT/
PPST
Disabled Port T I/O, Timer channels
NOTES:
1. Refer to PEAR register description in HCS12 Multiplexed External Bus Interface (MEBI) Block Guide
Pin Name
Function1
Pin Name
Function2
Pin Name
Function3
Pin Name
Function4
Powered
by
Internal Pull
Resistor
Description
CTRL
Reset
State
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