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参数资料
| 型号： | MC9S12NE64VTU |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 258/554页 |
| 文件大小： | 0K |
| 描述： | IC MCU 25MHZ ETHERNET/PHY 80TQFP |
| 应用说明： | MC9S12NE64 Integrated Ethernet Controller Implementing an Ethernet Interface with the MC9S12NE64 Web Server Development with MC9S12NE64 and Open TCP |
| 标准包装： | 90 |
| 系列： | HCS12 |
| 核心处理器： | HCS12 |
| 芯体尺寸： | 16-位 |
| 速度： | 25MHz |
| 连通性： | EBI/EMI，以太网，I²C，SCI，SPI |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 38 |
| 程序存储器容量： | 64KB（64K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 8K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.375 V ~ 3.465 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 80-TQFP 裸露焊盘 |
| 包装： | 管件 |
| 产品目录页面： | 731 (CN2011-ZH PDF) |
| 配用： | EVB9S12NE64E-ND - BOARD EVAL FOR 9S12NE64 DEMO9S12NE64E-ND - DEMO BOARD FOR 9S12NE64 |
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Chapter 11 Ethernet Media Access Controller (EMACV1)
MC9S12NE64 Data Sheet, Rev. 1.1
330
Freescale Semiconductor
TXBYT — Transmit Frame Byte Counter
This11-bit read-only field indicates the number of bytes of the current frame that have been read from
the transmit buffer by the EMAC transmitter. This register does not include transmitted pad data that
is added to frames if less than the minimum amount of data is transmitted nor the FCS data that is
appended to the end of transmit frames. While sending pause frames with the PAUSE command, this
register is ignored.
BSLOT — Backoff Slot Time Counter
This 10-bit read-only field indicates the number of slot times (512 bit times) in progress during the
backoff delay. This counter clears at the end of backoff delay, which is set by the random algorithm.
The MISC[10] bit reads 0.
RETX — Retransmission Counter
This 4-bit read-only field indicates the current retransmission count if retransmission takes place due
to collision. The MISC[10:4] bits read 0.
RANDOM — Backoff Random Number
This10-bit read-only random number is generated for use by the backoff logic. The value returned
when reading this field is random if the transmitter is enabled. The MISC[10] bit reads 0.
11.4
Functional Description
The EMAC provides a 10/100 Mbps Ethernet media access control (MAC) function and is designed to
connect to a PHY device supporting MII. The EMAC is an 802.3 compliant Ethernet controller specically
optimized for 8-/16-bit embedded processors. The main components of the EMAC are the receiver,
transmitter, MAC ow control, MII management, and receive and transmit Ethernet buffer interfaces.
11.4.1
Ethernet Frame
In an Ethernet network, information is received or transmitted in the form of a frame. The frame format
used for Ethernet consists of preamble (PA), start frame delimiter (SFD), destination address (DA), source
address (SA), type/length eld, data eld, and frame check sequence (FCS). See Table 11-9.
Table 11-8. Miscellaneous Fields
Index
Field
Unit
0-2
None
Read 0s
3
TXBYT
Bytes
4
BSLOT
Slot time
5
RETX
Retransmissions
6
RANDOM
N/A
7
Reserved
Table 11-9. Ethernet Frame Structure
Preamble
Start Frame
Delimiter
Destination
Address
Source
Address
Type/ Length
Data
Frame Check
Sequence
7 bytes
1 bytes
6 bytes
2 bytes
46 to 1500 bytes
4 bytes
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