参数资料
型号: MCHC705KJ1CPE
厂商: Freescale Semiconductor
文件页数: 48/108页
文件大小: 0K
描述: IC MCU 8BIT 64 BYTES RAM 16PDIP
标准包装: 25
系列: HC05
核心处理器: HC05
芯体尺寸: 8-位
速度: 4MHz
外围设备: POR,WDT
输入/输出数: 10
程序存储器容量: 1.2KB(1.2K x 8)
程序存储器类型: OTP
RAM 容量: 64 x 8
电压 - 电源 (Vcc/Vdd): 3 V ~ 5.5 V
振荡器型: 内部
工作温度: -40°C ~ 85°C
封装/外壳: 16-DIP(0.300",7.62mm)
包装: 管件
Central Processor Unit (CPU)
MC68HC705KJ1 MC68HRC705KJ1 MC68HLC705KJ1 Data Sheet, Rev. 4.1
44
Freescale Semiconductor
BIT #opr
BIT opr
BIT opr,X
BIT ,X
Bit Test Accumulator with Memory Byte
(A)
∧ (M)
— —
IMM
DIR
EXT
IX2
IX1
IX
A5
B5
C5
D5
E5
F5
ii
dd
hh ll
ee ff
ff
2
3
4
5
4
3
BLO rel
Branch if Lower (Same as BCS)
PC
← (PC) + 2 + rel ? C = 1
— ————
REL
25
rr
3
BLS rel
Branch if Lower or Same
PC
← (PC) + 2 + rel ? C ∨ Z = 1 — ————
REL
23
rr
3
BMC rel
Branch if Interrupt Mask Clear
PC
← (PC) + 2 + rel ? I = 0
— ————
REL
2C
rr
3
BMI rel
Branch if Minus
PC
← (PC) + 2 + rel ? N = 1
— ————
REL
2B
rr
3
BMS rel
Branch if Interrupt Mask Set
PC
← (PC) + 2 + rel ? I = 1
— ————
REL
2D
rr
3
BNE rel
Branch if Not Equal
PC
← (PC) + 2 + rel ? Z = 0
— ————
REL
26
rr
3
BPL rel
Branch if Plus
PC
← (PC) + 2 + rel ? N = 0
— ————
REL
2A
rr
3
BRA rel
Branch Always
PC
← (PC) + 2 + rel ? 1 = 1
— ————
REL
20
rr
3
BRCLR n opr rel Branch if Bit n Clear
PC
← (PC) + 2 + rel ? Mn = 0
— ———
DIR (b0)
DIR (b1)
DIR (b2)
DIR (b3)
DIR (b4)
DIR (b5)
DIR (b6)
DIR (b7)
01
03
05
07
09
0B
0D
0F
dd rr
5
BRN rel
Branch Never
PC
← (PC) + 2 + rel ? 1 = 0
— ————
REL
21
rr
3
BRSET n opr rel Branch if Bit n Set
PC
← (PC) + 2 + rel ? Mn = 1
— ———
DIR (b0)
DIR (b1)
DIR (b2)
DIR (b3)
DIR (b4)
DIR (b5)
DIR (b6)
DIR (b7)
00
02
04
06
08
0A
0C
0E
dd rr
5
BSET n opr
Set Bit n
Mn
← 1
— ————
DIR (b0)
DIR (b1)
DIR (b2)
DIR (b3)
DIR (b4)
DIR (b5)
DIR (b6)
DIR (b7)
10
12
14
16
18
1A
1C
1E
dd
5
BSR rel
Branch to Subroutine
PC
← (PC) + 2; push (PCL)
SP
← (SP) – 1; push (PCH)
SP
← (SP) – 1
PC
← (PC) + rel
— ————
REL
AD
rr
6
CLC
Clear Carry Bit
C
← 0
— ——— 0
INH
98
2
CLI
Clear Interrupt Mask
I
← 0
— 0 ———
INH
9A
2
Table 4-6. Instruction Set Summary (Sheet 2 of 6)
Source
Form
Operation
Description
Effect
on CCR
Address
Mode
Opc
o
de
Ope
rand
Cy
cl
es
HIN Z C
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