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参数资料
| 型号： | MCIMX258CJM4A |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 16/153页 |
| 文件大小： | 0K |
| 描述： | IC MPU IMX25 IND 400MAPBGA |
| 标准包装： | 90 |
| 系列： | i.MX25 |
| 核心处理器： | ARM9 |
| 芯体尺寸： | 32-位 |
| 速度： | 400MHz |
| 连通性： | 1 线，CAN，EBI/EMI，以太网，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 128 |
| 程序存储器类型： | 外部程序存储器 |
| RAM 容量： | 144K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.15 V ~ 1.52 V |
| 数据转换器： | A/D 3x12b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 400-LFBGA |
| 包装： | 托盘 |
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i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 10
112
Freescale Semiconductor
assertion of soc is detected. Thus, if the soc signal is continuously asserted, the ADC undergoes successive
conversion cycles and achieves the maximum sampling rate. If soc is negated, no conversion is initiated.
Figure 82. Start-up Sequence
The output data can be read from adcout11...adcout0, and is available tdata nanoseconds after the rising
edge of eoc. The reset signal and the digital signals controlling the analog switches (ypsw, xpsw, ynsw,
xnsw) are totally asynchronous.
The following conditions are necessary to guarantee the correct operation of the ADC:
The input multiplexer selection (selin11…selin0) is stable during both the last clock cycle (14th)
and the first clock cycle (1st). The best way to guarantee this is to make the input multiplexer
selection during clock cycles 2 to 13.
The references are stable during clock cycle 1 to 13. The best way to guarantee this is to make the
reference multiplexer selection (selrefp and selrefn) before issuing an soc pulse and changing it
only after an eoc pulse has been acquired, during the last clock cycle (14).
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PDF描述 |
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参数描述 |
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