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参数资料
| 型号： | MEGA64C1-15AZ |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 16 MHz, RISC MICROCONTROLLER, PQFP32 |
| 封装： | 7 X 7 MM, 1 MM HEIGHT, 0.80 MM PITCH, LEAD FREE, PLASTIC, TQFP-32 |
| 文件页数： | 317/365页 |
| 文件大小： | 6388K |
| 代理商： | MEGA64C1-15AZ |
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55
7647F–AVR–04/09
ATmega16/32/64/M1/C1
7.4.1
Watchdog Timer Control Register - WDTCSR
Bit 7 - WDIF: Watchdog Interrupt Flag
This bit is set when a time-out occurs in the Watchdog Timer and the Watchdog Timer is config-
ured for interrupt. WDIF is cleared by hardware when executing the corresponding interrupt
handling vector. Alternatively, WDIF is cleared by writing a logic one to the flag. When the I-bit in
SREG and WDIE are set, the Watchdog Time-out Interrupt is executed.
Bit 6 - WDIE: Watchdog Interrupt Enable
When this bit is written to one and the I-bit in the Status Register is set, the Watchdog Interrupt is
enabled. If WDE is cleared in combination with this setting, the Watchdog Timer is in Interrupt
Mode, and the corresponding interrupt is executed if time-out in the Watchdog Timer occurs.
If WDE is set, the Watchdog Timer is in Interrupt and System Reset Mode. The first time-out in
the Watchdog Timer will set WDIF. Executing the corresponding interrupt vector will clear WDIE
and WDIF automatically by hardware (the Watchdog goes to System Reset Mode). This is use-
ful for keeping the Watchdog Timer security while using the interrupt. To stay in Interrupt and
System Reset Mode, WDIE must be set after each interrupt. This should however not be done
within the interrupt service routine itself, as this might compromise the safety-function of the
Watchdog System Reset mode. If the interrupt is not executed before the next time-out, a Sys-
tem Reset will be applied.
Note:
1. For the WDTON Fuse “1” means unprogrammed while “0” means programmed.
Bit 4 - WDCE: Watchdog Change Enable
This bit is used in timed sequences for changing WDE and prescaler bits. To clear the WDE bit,
and/or change the prescaler bits, WDCE must be set.
Once written to one, hardware will clear WDCE after four clock cycles.
Bit 3 - WDE: Watchdog System Reset Enable
WDE is overridden by WDRF in MCUSR. This means that WDE is always set when WDRF is
set. To clear WDE, WDRF must be cleared first. This feature ensures multiple resets during con-
ditions causing failure, and a safe start-up after the failure.
Bit 5, 2..0 - WDP3..0: Watchdog Timer Prescaler 3, 2, 1 and 0
The WDP3..0 bits determine the Watchdog Timer prescaling when the Watchdog Timer is run-
ning. The different prescaling values and their corresponding time-out periods are shown in
Bit
76543210
WDIF
WDIE
WDP3
WDCE
WDE
WDP2
WDP1
WDP0
WDTCSR
Read/Write
R/W
Initial Value
0000
X
000
Table 7-5.
Watchdog Timer Configuration
WDTON
WDE
WDIE
Mode
Action on Time-out
0
Stopped
None
0
1
Interrupt Mode
Interrupt
0
1
0
System Reset Mode
Reset
01
1
Interrupt and System Reset
Mode
Interrupt, then go to System
Reset Mode
1
x
System Reset Mode
Reset
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| MEGA64C1-15MZ | 制造商:ATMEL 制造商全称:ATMEL Corporation 功能描述:8-bit Microcontroller with 16K/32K/64K Bytes In-System Programmable Flash |
| MEGA64C1-ESAZ | 制造商:ATMEL 制造商全称:ATMEL Corporation 功能描述:8-bit Microcontroller with 16K/32K/64K Bytes In-System Programmable Flash |
| MEGA64C1-ESMZ | 制造商:ATMEL 制造商全称:ATMEL Corporation 功能描述:8-bit Microcontroller with 16K/32K/64K Bytes In-System Programmable Flash |
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| MEGA64M1-15MZ | 制造商:ATMEL 制造商全称:ATMEL Corporation 功能描述:8-bit Microcontroller with 16K/32K/64K Bytes In-System Programmable Flash |
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