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参数资料
| 型号： | MK20N512VML100R |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | RISC MICROCONTROLLER, PBGA104 |
| 封装： | 8 X 8 MM, MAPBGA-104 |
| 文件页数： | 14/61页 |
| 文件大小： | 888K |
| 代理商： | MK20N512VML100R |
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Table 11. JTAG electricals (continued)
Symbol
Description
Min.
Max.
Unit
J3
TCLK clock pulse width
JTAG and CJTAG
Serial Wire Debug
20
10
—
ns
J4
TCLK rise and fall times
—
3
ns
J5
Boundary scan input data setup time to TCLK rise
20
—
ns
J6
Boundary scan input data hold time after TCLK rise
0
—
ns
J7
TCLK low to boundary scan output data valid
—
30
ns
J8
TCLK low to boundary scan output high-Z
—
30
ns
J9
TMS, TDI input data setup time to TCLK rise
16
—
ns
J10
TMS, TDI input data hold time after TCLK rise
1
—
ns
J11
TCLK low to TDO data valid
—
4
ns
J12
TCLK low to TDO high-Z
—
4
ns
J13
TRST assert time
100
—
ns
J14
TRST setup time (negation) to TCLK high
8
—
ns
J2
J3
J4
TCLK (input)
Figure 5. Test clock input timing
Peripheral operating requirements and behaviors
K20 Sub-Family Data Sheet Data Sheet, Rev. 1, 11/2010.
Freescale Semiconductor, Inc.
Preliminary
21
Preliminary
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PDF描述 |
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参数描述 |
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