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参数资料
| 型号： | MK2761ASLF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 2/7页 |
| 文件大小： | 0K |
| 描述： | IC CLK SOURCE SET-TOP 16-SOIC |
| 标准包装： | 48 |
| 类型： | 时钟/频率合成器 |
| PLL： | 带旁路 |
| 输入： | 时钟，晶体 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:7 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 27MHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 16-SOIC |
| 包装： | 管件 |
MK2761A
SET-TOP CLOCK SOURCE
CLOCK SYNTHESIZER
IDT SET-TOP CLOCK SOURCE
2
MK2761A
REV F 051310
Pin Assignment
Audio Clock (MHz) DecodingTable
Pin Descriptions
1
2
3
GND
4
X2
5
6
27 MHz
7
8
27 MHz
VDD
27 MHz
3.68 MHz
ACS0
16.67 MHz
GND
X1/ICLK
16
ACS1
VDD
ACLK
27 MHz
GND
15
14
13
12
11
10
9
16-pin (150 mil) SOIC
ACS1
ACS0
ACLK
0
8.192
0
1
11.2896
1
0
12.288
1
5.6448
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
ACS1
Input
Audio clock Select 1. Selects ACLK on pin 8. See table above.
2
X2
XO
Crystal connection. Connect to 27 MHz crystal. Leave unconnected for clock
input.
3
X1/ICLK
XI
Crystal connection. Connect to 27 MHz crystal or to a 27 MHz input clock.
4
VDD
Power
Connect to +5 V.
5
GND
Power
Connect to ground.
6
16.67M
Output
16.667 MHz processor clock output.
7
3.68M
Output
3.6864 MHz clock output.
8
ACLK
Output
Audio clock output. Determined by status of ACS1, ACS0. See table above
9
GND
Power
Connect to ground.
10
27M
Output
27 MHz buffered reference clock output. Duty cycle matches input clock.
11
27M
Output
27 MHz buffered reference clock output. Duty cycle matches input clock.
12
GND
Power
Connect to ground.
13
VDD
Power
Connect to +5 V.
14
27M
Output
27 MHz buffered reference clock output. Duty cycle matches input clock.
15
27M
Output
27 MHz buffered reference clock output. Duty cycle matches input clock.
16
ACS0
Input
Audio clock Select 0. Selects audio clock on pin 8. See table above.
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PDF描述 |
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参数描述 |
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