参数资料
型号: MK2761ASLF
厂商: IDT, Integrated Device Technology Inc
文件页数: 4/7页
文件大小: 0K
描述: IC CLK SOURCE SET-TOP 16-SOIC
标准包装: 48
类型: 时钟/频率合成器
PLL: 带旁路
输入: 时钟,晶体
输出: CMOS
电路数: 1
比率 - 输入:输出: 2:7
差分 - 输入:输出: 无/无
频率 - 最大: 27MHz
除法器/乘法器: 无/无
电源电压: 4.5 V ~ 5.5 V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 16-SOIC(0.154",3.90mm 宽)
供应商设备封装: 16-SOIC
包装: 管件
MK2761A
SET-TOP CLOCK SOURCE
CLOCK SYNTHESIZER
IDT SET-TOP CLOCK SOURCE
4
MK2761A
REV F 051310
DC Electrical Characteristics
VDD = 5.0 V ±10% (unless otherwise noted), Temp 0 to +70
° C
Note 1: With ACLK clock at 12.28 MHz.
AC Electrical Characteristics
VDD = 5.0 V ±10% (unless otherwise noted), Temp 0 to +70
° C
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Operating Voltage
VDD
4.5
5.5
V
Input High Voltage
VIH
X1/ICLK pin only
3.5
2.5
V
Input Low Voltage
VIL
X1/ICLK pin only
2.5
1.5
V
Input High Voltage
VIH
2V
Input Low Voltage
VIL
0.8
V
Output High Voltage
VOH
IOH = -25 mA
2.4
V
Output Low Voltage
VOL
IOL = 25 mA
0.4
V
Output High Voltage, CMOS
level
VOH
IOH = -8 mA
VDD-0.4
V
Operating Supply Current
IDD
No load, Note 1
65
mA
Short Circuit Current
IOS
Each output
±100
mA
Input Capacitance
CIN
7pF
Frequency Error, ACLK
0
ppm
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
27
MHz
Output Clock Rise Time
tOR
0.8 to 2.0 V
1.5
ns
Output Clock Fall Time
tOF
2.0 to 0.8 V
1.5
ns
Output Clock Duty Cycle
At 1.4 V
40
60
%
Absolute Jitter, short term
Variation from mean
±250
ps
Skew of 27 MHz Outputs
Rising edges at 1.4 V
-500
0
500
ps
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