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参数资料
| 型号： | MK53DX256ZCMD10 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PBGA144 |
| 封装： | 13 X 13 MM, MAPBGA-144 |
| 文件页数： | 57/82页 |
| 文件大小： | 1124K |
| 代理商： | MK53DX256ZCMD10 |
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TBD
Figure 23. Typical output vs. VDD
6.7 Timers
6.8 Communication interfaces
6.8.1 Ethernet switching specifications
The following timing specs are defined at the chip I/O pin and must be translated
appropriately to arrive at timing specs/constraints for the physical interface.
6.8.1.1 MII signal switching specifications
The following timing specs meet the requirements for MII style interfaces for a range of
transceiver devices.
Table 43. MII signal switching specifications
Symbol
Description
Min.
Max.
Unit
—
RXCLK frequency
—
25
MHz
MII1
RXCLK pulse width high
35%
65%
RXCLK
period
MII2
RXCLK pulse width low
35%
65%
RXCLK
period
MII3
RXD[3:0], RXDV, RXER to RXCLK setup
5
—
ns
MII4
RXCLK to RXD[3:0], RXDV, RXER hold
5
—
ns
—
TXCLK frequency
—
25
MHz
MII5
TXCLK pulse width high
35%
65%
TXCLK
period
MII6
TXCLK pulse width low
35%
65%
TXCLK
period
MII7
TXCLK to TXD[3:0], TXEN, TXER invalid
2
—
ns
MII8
TXCLK to TXD[3:0], TXEN, TXER valid
—
25
ns
Peripheral operating requirements and behaviors
K53 Sub-Family Data Sheet Data Sheet, Rev. 5, 5/2011.
60
Preliminary
Freescale Semiconductor, Inc.
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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| MK53X256CMD100 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Up to 100 MHz ARM Cortex-M4 core with DSP instructions delivering 1.25 Dhrystone MIPS per MHz |
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